參數(shù)資料
型號： CYWUSB6934-48LFXC
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類： 通信及網(wǎng)絡(luò)
英文描述： Multiconductor Cable; Number of Conductors:2; Conductor Size AWG:18; No. Strands x Strand Size:7 x 26; Jacket Material:Polyvinylchloride (PVC); Leaded Process Compatible:Yes; Capacitance:30pF/ft; Conductor Material:Copper RoHS Compliant: Yes
中文描述： SPECIALTY TELECOM CIRCUIT, QCC48
封裝： 7 X 7 MM, LEAD FREE, MO-220, QFN-48
文件頁數(shù)： 22/30頁
文件大小： 305K
代理商： CYWUSB6934-48LFXC
CYWUSB6932
CYWUSB6934
Document 38-16007 Rev. *G
Page 22 of 30
8.0
Pin Definitions
Table 8-1. Pin Description Table for the CYWUSB6932/CYWUSB6934
Pin QFN
46
5
38
35
26
33
Name
RFIN
RFOUT
X13
X13IN
X13OUT
PD
Type
Input
Output
Input
Input
Output/Hi-Z
Input
Default
Input
N/A
N/A
N/A
Output
N/A
Description
RF Input
. Modulated RF signal received (CYWUSB6934 only).
RF Output
. Modulated RF signal to be transmitted.
Crystal Input
. (refer to
Section 4.6
).
Crystal Input
. (refer to
Section 4.6
).
System Clock
. Buffered 13-MHz system clock.
Power Down
. Asserting this input (low), will put the
CYWUSB6932/CYWUSB6934 in the Suspend Mode (X13OUT is 0 when PD
is Low).
Active LOW Reset
. Device reset.
PACTL
. External Power Amplifier control. Pull-down or make output.
Data Input/Output.
SERDES Bypass Mode Data Transmit/Receive.
Data I/O Valid
. SERDES Bypass Mode Data Transmit/Receive Valid.
IRQ
. Interrupt and SERDES Bypass Mode DIOCLK.
Master-Output-Slave-Input Data
. SPI data input pin.
Master-Input-Slave-Output Data
. SPI data output pin.
SPI Input Clock
. SPI clock.
Slave Select Enable
. SPI enable.
V
CC
= 2.7V to 3.6V.
14
34
20
19
21
23
24
25
22
RESET
PACTL
DIO
DIOVAL
IRQ
MOSI
MISO
SCK
SS
Input
I/O
I/O
I/O
N/A
Input
Input
Input
Output
N/A
Hi-Z
N/A
N/A
Output /Hi-Z
Input
Output/Hi-Z
Input
Input
6, 9, 16, 28,
29, 32, 41,
42, 44, 45
13
1, 2, 3, 4, 7,
8, 10, 11,
12, 15, 17,
18, 27, 30,
31, 36, 37,
39, 40, 43,
47, 48
Exposed
Paddle
VCC
VCC
H
GND
GND
L
Ground = 0V
.
Must be tied to Ground.
NC
N/A
N/A
GND
GND
L
Must be tied to Ground.
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PDF描述
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