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參數(shù)資料
| 型號： | CXA3266Q |
| 元件分類： | PLL合成/DDS/VCOs |
| 英文描述： | PHASE LOCKED LOOP, 0.12 MHz, PQFP48 |
| 封裝： | PLASTIC, QFP-48 |
| 文件頁數(shù)： | 54/62頁 |
| 文件大?。?/td> | 929K |
| 代理商： | CXA3266Q |
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CXA3266Q
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(2) Description of readout mode
This program has a function (readout mode) that reads the contents written to the control registers
from the CXA3266Q SEROUT (Pin 15) and displays these contents on the screen. This function is
described below.
(a) Set SCAN to ON at the function setting screen.
(b) Press the S key.
The following screen appears.
This screen conforms to the Control Register Table listed in the CXA3266Q data sheet.
(c) Press the R key to return to the original function setting screen.
(3) Quit the program
Press the A key to quit the program.
SCAN RESULT, CXA3266 PLL REGISTERS
Register 1 DIVREG1
00111000
Register 2 DIVREG2
0101
Register 3 CENFREREG
01
Register 4 DELAYREG
00100000
Register 5 CPREG
100110
Register 6 TTLPOLREG
11111111
Register 7 TESTPOWREG
111111
Press r to return to PLL REGISTERS MENU.
Press a to abort
MIXED SIGNAL SYSTEMS AUG 1998
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