參數(shù)資料
型號： AMD64
英文描述： AMD64 Architecture Programmer＇s Manual Volume 1: Application Programming
中文描述： AMD64架構(gòu)程序員手冊卷1：應用程序編程
文件頁數(shù)： 38/400頁
文件大?。?/td> 2948K
代理商： AMD64
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4
Chapter 1: Overview of the AMD64 Architecture
AMD 64-Bit Technology
24593—Rev. 3.09—September 2003
As Table 1-2 shows, the legacy x86 architecture (called
legacy
mode
in the AMD64 architecture) supports eight GPRs. In
reality, however, the general use of at least four registers (EBP,
ESI, EDI, and ESP) is compromised because they serve special
purposes when executing many instructions. The AMD64
architecture’s addition of eight new GPRs—and the increased
width of these registers from 32 bits to 64 bits—allows
compilers to substantially improve software performance.
Compilers have more flexibility in using registers to hold
variables. Compilers can also minimize memory traffic—and
thus boost performance—by localizing work within the GPRs.
1.1.3
Instruction Set
The AMD64 architecture supports the full legacy x86
instruction set, and it adds a few new instructions to support
long mode (see Table 1-1 for a summary of operating modes).
The application-programming instructions are organized and
described in the following subsets:
General-Purpose Instructions
—These are the basic x86
integer instructions used in virtually all programs. Most of
Table 1-2.
Application Registers and Stack, by Operating Mode
Register
or Stack
Legacy and Compatibility Modes
64-Bit Mode
1
Name
Number
Size (bits)
Name
Number
Size (bits)
General-Purpose
Registers (GPRs)
2
EAX, EBX, ECX,
EDX, EBP, ESI,
EDI, ESP
8
32
RAX, RBX, RCX,
RDX, RBP, RSI,
RDI, RSP, R8–R15
16
64
128-Bit XMM Registers
XMM0–XMM7
8
128
XMM0–XMM15
16
128
64-Bit MMX Registers
MMX0–MMX7
3
8
64
MMX0–MMX7
3
8
64
x87 Registers
FPR0–FPR7
3
8
80
FPR0–FPR7
3
8
80
Instruction Pointer
2
EIP
1
32
RIP
1
64
Flags
2
EFLAGS
1
32
RFLAGS
1
64
Stack
—
16 or 32
—
64
Note:
1. Gray-shaded entries indicate differences between the modes. These differences (except stack-width difference) are the AMD64
architecture’s register extensions.
2. This list of GPRs shows only the 32-bit registers. The 16-bit and 8-bit mappings of the 32-bit registers are also accessible, as
described in “Registers” on page 27.
3. The MMX0–MMX7 registers are mapped onto the FPR0–FPR7 physical registers, as shown in Figure 1-1. The x87 stack registers,
ST(0)–ST(7), are the logical mappings of the FPR0–FPR7 physical registers.
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