參數(shù)資料
型號： AMD64
英文描述： AMD64 Architecture Programmer＇s Manual Volume 1: Application Programming
中文描述： AMD64架構(gòu)程序員手冊卷1：應用程序編程
文件頁數(shù)： 234/400頁
文件大?。?/td> 2948K
代理商： AMD64
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200
Chapter 4: 128-Bit Media and Scientific Programming
AMD 64-Bit Technology
24593—Rev. 3.09—September 2003
single-precision floating-point value in the second operand and
writes the result in the corresponding doubleword of the
destination. The MULPD instruction performs an analogous
operation for two double-precision floating-point values.
The MULSS instruction multiplies the single-precision floating-
point value in the low-order doubleword of the first operand by
the single-precision floating-point value in the low-order
doubleword of the second operand and writes the result in the
low-order doubleword of the destination. The three high-order
doublewords of the destination are not modified.
The MULSD instruction multiplies the double-precision
floating-point value in the low-order quadword of the first
operand by the double-precision floating-point value in the low-
order quadword of the second operand and writes the result in
the low-order quadword of the destination. The high-order
quadword of the destination is not modified.
Division.
DIVPS—Divide Packed Single-Precision Floating-Point
DIVPD—Divide Packed Double-Precision Floating-Point
DIVSS—Divide Scalar Single-Precision Floating-Point
DIVSD—Divide Scalar Double-Precision Floating-Point
The DIVPS instruction divides each of the four single-precision
floating-point values in the first operand by the corresponding
single-precision floating-point value in the second operand and
writes the result in the corresponding quadword of the
destination. The DIVPD instruction performs an analogous
operation for two double-precision floating-point values. For
vectors of
n
number of elements, the operations are:
operand1[i] = operand1[i]
÷
operand2[i]
where: i = 0 to n – 1
The DIVSS instruction divides the single-precision floating-
point value in the low-order doubleword of the first operand by
the single-precision floating-point value in the low-order
doubleword of the second operand and writes the result in the
low-order doubleword of the destination. The three high-order
doublewords of the destination are not modified.
The DIVSD instruction divides the double-precision floating-
point value in the low-order quadword of the first operand by
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