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參數(shù)資料
| 型號： | AMD64 |
| 英文描述： | AMD64 Architecture Programmer＇s Manual Volume 1: Application Programming |
| 中文描述： | AMD64架構(gòu)程序員手冊卷1：應(yīng)用程序編程 |
| 文件頁數(shù)： | 227/400頁 |
| 文件大小： | 2948K |
| 代理商： | AMD64 |
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Chapter 4: 128-Bit Media and Scientific Programming
193
24593—Rev. 3.09—September 2003
AMD 64-Bit Technology
precision floating-point values in the low-order 64 bits of the
destination. The high-order 64 bits in the destination XMM
register are cleared to all 0s. If the result of the conversion is an
inexact value, the value is rounded.
The CVTSS2SD instruction converts a single-precision floating-
point value in the low-order 32 bits of the second operand to a
double-precision floating-point value in the low-order 64 bits of
the destination. The high-order 64 bits in the destination XMM
register are not modified.
The CVTSD2SS instruction converts a double-precision
floating-point value in the low-order 64 bits of the second
operand to a single-precision floating-point value in the low-
order 64 bits of the destination. The three high-order
doublewords in the destination XMM register are not modified.
If the result of the conversion is an inexact value, the value is
rounded.
Convert Floating-Point to XMM Integer.
These instructions convert
floating-point data types in XMM registers or memory into
integer data types in XMM registers.
CVTPS2DQ—Convert Packed Single-Precision Floating-
Point to Packed Doubleword Integers
CVTPD2DQ—Convert Packed Double-Precision Floating-
Point to Packed Doubleword Integers
CVTTPS2DQ—Convert Packed Single-Precision Floating-
Point to Packed Doubleword Integers, Truncated
CVTTPD2DQ—Convert Packed Double-Precision Floating-
Point to Packed Doubleword Integers, Truncated
The CVTPS2DQ and CVTTPS2DQ instructions convert four
single-precision floating-point values in the second operand to
four 32-bit signed integer values in the destination. For the
CVTPS2DQ instruction, if the result of the conversion is an
inexact value, the value is rounded, but for the CVTTPS2DQ
instruction such a result is truncated (rounded toward zero).
The CVTPD2DQ and CVTTPD2DQ instructions convert two
double-precision floating-point values in the second operand to
two 32-bit signed integer values in the destination. The high-
order 64 bits in the destination XMM register are cleared to all
0s. For the CVTPD2DQ instruction, if the result of the
conversion is an inexact value, the value is rounded, but for the
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