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參數(shù)資料
| 型號： | AM79C974 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | PCnetTM-SCSI Combination Ethernet and SCSI Controller for PCI Systems |
| 中文描述： | PCnetTM -的SCSI結(jié)合以太網(wǎng)和SCSI控制器PCI系統(tǒng) |
| 文件頁數(shù)： | 29/153頁 |
| 文件大?。?/td> | 838K |
| 代理商： | AM79C974 |
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P R E L I M I N A R Y
AMD
29
Am79C974
Slave I/O Transfers
After the Am79C974 controller is configured as I/O de-
vice (by setting IOEN in the PCI Command register), it
starts monitoring the PCI bus for access to its internal
registers. The Am79C974 controller will look for an ad-
dress that falls within its I/O address space. The
Am79C974 controller will assert
DEVSEL
if it detects an
address match and the access is an I/O cycle.
DEVSEL
is asserted two clock cycles after the host has asserted
FRAME
. The Am79C974 controller will not assert
DEV-
SEL
if it detects an address match, but the PCI com-
mand is not of the type I/O read or I/O write. The
Am79C974 controller will suspend looking for I/O cycles
while being a bus master.
Slave I/O Read
The Slave I/O Read command is used by the host CPU
to read the Am79C974’s CSRs, BCRs and EEPROM lo-
cations and SCSI and CCB registers. It is a single cycle,
non-burst 8-bit,16-bit or 32-bit transfer which is initiated
by the host CPU. The typical number of wait states
added to a slave I/O read access on the part of the
Am79C974 controller is 6 to 7 clock cycles. The
Am79C974 controller will not produce Slave I/O Read
commands while being a bus master.
FRAME
CLK
AD
IRDY
TRDY
C/
BE
1
2
3
4
5
6
7
8
ADDR
DATA
0010
BE
's
9
10
11
PAR
PAR
PAR
STOP
DEVSEL
18681A-7
Figure 3.
Slave I/O Read
相關(guān)PDF資料 |
PDF描述 |
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