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參數(shù)資料
| 型號： | ADUC7023BCPZ62I-RL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 90/96頁 |
| 文件大小： | 0K |
| 描述： | IC MCU 12BIT 62KB FLASH 32LFCSP |
| 標準包裝： | 5,000 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 44MHz |
| 連通性： | I²C，SPI |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 12 |
| 程序存儲器容量： | 64KB（32K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 32 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x12b，D/A 4x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 32-WFQFN 裸露焊盤，CSP |
| 包裝： | 帶卷 (TR) |
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ADuC7023
Data Sheet
| Page 90 of 96
POWER-ON RESET OPERATION
An internal power-on reset (POR) is implemented on the
ADuC7023. For LVDD below 2.40 V typical, the internal POR
holds the part in reset. As LVDD rises above 2.40 V, an internal
timer times out for typically 64 ms before the part is released
from reset. The user must ensure that the power supply IOVDD
has reached a stable 2.7 V minimum level by this time. Likewise, on
power-down, the internal POR holds the part in reset until
LVDD has dropped below 2.40 V.
Figure 53 illustrates the operation of the internal POR in detail.
0
8675
-047
IOVDD
3.3V
2.6V
2.40V TYP
64ms TYP
LVDD
POR
Figure 53. Internal Power-On Reset Operation
Rev. E
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