參數(shù)資料
型號(hào)： AD14160LKB-4
廠商： ANALOG DEVICES INC
元件分類： 數(shù)字信號(hào)處理
英文描述： Quad-SHARC DSP Multiprocessor Family
中文描述： 48-BIT, 40 MHz, OTHER DSP, CBGA452
封裝： CERAMIC, BGA-452
文件頁(yè)數(shù)： 39/52頁(yè)
文件大?。?/td> 1193K
代理商： AD14160LKB-4
AD14160/AD14160L
–39–
REV. A
LOAD CAPACITANCE – pF
16.0
8.0
00
200
20
40
60
80
100
120
140
160
180
14.0
12.0
4.0
2.0
10.0
6.0
FALL TIME
RISE TIME
R
(
Y = 0.005X + 3.7
Y = 0.0031X + 1.1
Figure 31. Typical Output Rise Time (10%–90%)
vs. Load Capacitance (V
DD
= 5 V)
LOAD CAPACITANCE – pF
0
2
0
20
40
60
80
100
120
Y = 0.0796X + 1.17
Y = 0.0467X + 0.55
RISE TIME
FALL TIME
140
160
180
200
4
6
8
10
12
14
16
18
R
Figure 32. Typical Output Rise Time (10%–90%)
vs. Load Capacitance (V
DD
= 3.3 V)
3.5
0
R
3.0
2.5
2.0
1.5
1.0
0.5
LOAD CAPACITANCE – pF
0
200
20
40
60
80
100
120
140
160
180
FALL TIME
RISE TIME
Y = 0.009X + 1.1
Y = 0.005X + 0.6
Figure 33. Typical Output Rise Time (0.8 V–2.0 V)
vs. Load Capacitance (V
DD
= 5 V)
LOAD CAPACITANCE – pF
0
0
20
40
60
80
100
120
Y = 0.0391X + 0.36
Y = 0.0305X + 0.24
RISE TIME
FALL TIME
140
160
180
200
R
1
2
3
4
5
6
7
8
9
Figure 34. Typical Output Rise Time (0.8 V –2.0 V)
vs. Load Capacitance (V
DD
= 3.3 V)
LOAD CAPACITANCE – pF
O
5
–1
25
200
50
75
100
125
150
175
4
3
2
1
NOMINAL
Y = 0.03X –1.45
Figure 35. Typical Output Delay or Hold vs. Load Capaci-
tance (at Maximum Case Temperature) (V
DD
= 5 V)
LOAD CAPACITANCE – pF
O
5
–1
25
200
50
75
100
125
150
175
4
3
2
1
NOMINAL
Y = 0.0329X –1.65
Figure 36. Typical Output Delay or Hold vs. Load Capaci-
tance (at Maximum Case Temperature) (V
DD
= 3.3 V)
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AD1555AP 24-Bit ADC WITH LOW NOISE PGA
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AD-1434-ACD30FT-LPG-HOSE 制造商:TE Connectivity 功能描述:
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