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參數(shù)資料
| 型號： | 28229-14 |
| 廠商： | MINDSPEED TECHNOLOGIES INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA256 |
| 封裝： | BGA-256 |
| 文件頁數(shù)： | 47/269頁 |
| 文件大?。?/td> | 3376K |
| 代理商： | 28229-14 |
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7-40
Mindspeed Technologies
28229-DSH-001-B
Registers
CX28224/5/9 Data Sheet
0x0D—UTOP1 (UTOPIA Control Register 1)
The UTOP1 register controls the UTOPIA resets, parity orientation, and the transmit
FIFO fill-level threshold.
0x0E—UTOP2 (UTOPIA Control Register 2) (TC Block)
The UTOP2 register contains the multi-PHY address value for the port.
Bit
Default
Name
Description
7
0
TxReset
When written to a logical 1, this bit resets the transmit FIFO pointers. This reset
should only be used as a test function because it can create short cells.
6
0
RxReset
When written to a logical 1, this bit resets the receive FIFO pointers. This reset
should only be used as a test function because it can create short cells.
50
—
Reserved, write to a logical 0.
40
—
Reserved, write to a logical 0.
30
—
Reserved, write to a logical 0.
20
—
Reserved, write to a logical 0.
10
—
Reserved, write to a logical 0.
00
—
Reserved, write to a logical 0.
FOOTNOTE:
(1) These bits should only be changed when the device or port logic reset is asserted.
Bit
Default
Name
Description
70
—
Reserved, write to a logical 0.
60
—
Reserved, write to a logical 0.
5x
UtopDis(1)
When written to a logical 1, this bit disables UTOPIA outputs for this port.
4
0
MphyAddr[4]—
MSB(1)
These bits are the Multi-PHY Device Address. Each CX2822x port should have a
unique address. These bits correspond to the URxAddr and UTxAddr pins. When
the pin matches the bit values, the port is accessed. This port ignores any
transactions meant for another port or PHY device.
30
MphyAddr[3](1)
2(2)
MphyAddr[2](1)
1(2)
MphyAddr[1](1)
0
(2)
MphyAddr[0]—
LSB(1)
FOOTNOTE:
(1) These bits should only be changed when the device or port logic reset is asserted.
(2) The default for these bits is the port number for each port. (000—Port 0, 001—Port 1, 010—Port 2, 011—Port 3, 100—Port 4,
101—Port 5, 110—Port 6, 111—Port 7)
Version
Default
CX28229-11
0
CX28229-12 and later
1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 28230-13 | ATM SEGMENTATION AND REASSEMBLY DEVICE, PQFP208 |
| 28L0138-40R | 1 FUNCTIONS, FERRITE BEAD |
| 28L0138-70R | 1 FUNCTIONS, FERRITE BEAD |
| 28Z551 | TELECOM FILTER |
| 28Z550 | TELECOM FILTER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 28-22916 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD PRECISION TIMER 15S-60MIN |
| 28-22918 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD PRECISION TIMER 0.1-10 SEC |
| 28-22920 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD PRECISION TIMER 1-99 SEC |
| 28-22922 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD SEQUENTIAL TIMER 1SEC-3MIN |
| 28-22926 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD ON DELAY TIMER 1-60 SECOND |
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