參數(shù)資料
型號： XRT94L33IB
廠商： Exar Corporation
文件頁數(shù)： 324/465頁
文件大小： 0K
描述： IC MAPPER DS3/E3/STS-1 504TBGA
標準包裝： 24
應(yīng)用： 網(wǎng)絡(luò)切換
接口： 總線
電源電壓： 3.14 V ~ 3.47 V
封裝/外殼： 504-LBGA
供應(yīng)商設(shè)備封裝： 504-TBGA（35x35）
包裝： 托盤
安裝類型： 表面貼裝
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XRT94L33
xr
Rev.1.2.0.
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
390
Configuring the Receive STS-3c POH Processor block to increment the “Receive STS-3c Path – REI-P
Error Count” Register on an “REI-P Value” basis.
The user can configure the Receive STS-3c TOH Processor block to increment the “Receive STS-3c Path –
REI-P Error Count” Register by the contents within the “REI-P” nibbles, within each incoming STS-3c SPE.
Therefore, in this mode, it is possible for the Receive STS-3c POH Processor block to increment this register
by as much as the value “8” per STS-3c SPE.
The user can accomplish this by setting Bit 1 (REI-P Error Type) within the “Receive STS-3c Path – Control
Register – Byte 0” to “0”, as illustrated below.
Receive STS-3c Path – Control Register – Byte 0 (Address = 0x1183)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
Check
Stuff
RDI-P
Type
REI-P
Error Type
B3 Error
Type
R/O
R/W
0
2.3.2.3
PATH BIP-8 (B3) BYTE VERIFICATION
Configuring the Receive STS-3c POH Processor block to increment the “Receive STS-3c Path – B3
Error Count” Register on a “per-SPE” basis.
The Receive STS-3c POH Processor block has the responsibility for computing and verifying the Path BIP-8
(e.g., B3) byte within each incoming STS-3c SPE. When the Receive STS-3c POH Processor block executes
this function, it will do the following.
It will read in the contents of a given “newly received” STS-3c SPE.
It will compute the BIP-8 value over the SPE.
This resulting BIP-8 value will be compared with the contents of the B3 byte, within the very next STS-3c
SPE.
The user can configure the Receive STS-3c POH Processor block to increment the “Receive STS-3c Path –
B3 Error Count” Register, by the value “1” for each STS-3c SPE that it determined to have a bit-error.
The user can accomplish this by setting Bit 0 (B3 Error Type), within the “Receive STS-3c Path – Control
Register – Byte 0” to “1”, as illustrated below.
Receive STS-3c Path – Control Register – Byte 0 (Address = 0x1183)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
Check Stuff
RDI-P Type
REI-P Error
Type
B3 Error
Type
R/O
R/W
0
1
Note:
This the user implements this setting, then the corresponding Transmit STS-3c POH Processor block will set the
REI-P nibble value (within the G1 byte) to the number of erred SPE that have been detected. In this case, the
maximum value that the REI-P nibble (within an STS-3c SPE) will contain will be “1”.
If the Receive STS-3c POH Processor block detects any B3 byte errors, then it will do the following.
a. It will generate the “Detection of B3 Error” Interrupt, by toggling the “INT*” output pin “LOW” and by
setting Bit 7 (Detection of B3 Byte Error Interrupt Status) to “1” as indicated below.
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PDF描述
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5413558-1 CONN JACK BNC RT ANG 75 OHM GOLD
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參數(shù)描述
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XRT94L33IB-L 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Mapper / Demapper RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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