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參數資料
| 型號： | XRT94L33IB |
| 廠商： | Exar Corporation |
| 文件頁數： | 188/465頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAPPER DS3/E3/STS-1 504TBGA |
| 標準包裝： | 24 |
| 應用： | 網絡切換 |
| 接口： | 總線 |
| 電源電壓： | 3.14 V ~ 3.47 V |
| 封裝/外殼： | 504-LBGA |
| 供應商設備封裝： | 504-TBGA（35x35） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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XRT94L33
xr
Rev.1.2.0.
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
268
2.2.8.3.3.3
Configuring the Transmit SONET POH Processor block to transmit the REI-P indicator,
via the “TxPOH_n” input port
The user can configure the Transmit SONET POH Processor block to transmit the REI-P (per the external
input port) by executing the following steps.
STEP 1 – Write the value [1, 0] into Bits 3 and 4 (REI-P Insertion Type[1:0]) within the “Transmit
SONET Path – SONET Control Register – Byte 0” as depicted below.
Transmit SONET Path – SONET Control Register – Byte 0 (Address = 0xN983)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
F2 Insertion
Type
REI-P Insertion Type[1:0]
RDI-P Insertion Type[1:0]
C2 Byte
Insertion
Type
C2 Byte
Auto Insert
Mode
Enable
Transmit
AIS-P
Enable
R/W
0
1
0
This step configures the Transmit SONET POH Processor block to set the value of the REI-P bit-fields (within
the outbound STS-1 SPE) based upon the data that it receives via the “TxPOH_n” input port. In this mode,
the Transmit SONET POH Processor block will accept the value corresponding to the REI-P fields (via the
“TxPOH_n Input Port”) and it will write this data into the “outbound” STS-1 SPE data-stream.
STEP 2 – Begin providing the values of the “outbound” REI-P bit-fields to the “TxPOH_n” input port.
The procedure for applying the REI-P bit-values to the “TxPOH_n” input port is presented below.
Using the “TxPOH” Input Port to insert the REI-P bit values into the outbound STS-1 SPE data-stream
If the user intends to externally insert the REI-P bits into the outbound STS-1 SPE, via the “TxPOH_n” input
port, then they must design some external circuitry (which can be realized in an ASIC, FPGA or CPLD
solution) to do the following.
Continuously sample the “TxPOHEnable_n” and the “TxPOHEnable_n” output pins upon the rising edge
of the “TxPOHClk_n” output clock signal.
Whenever the “external circuit” samples both the “TxPOHEnable_n” and “TxPOHFrame_n” output pins
“high”, then it should enter a “WAIT STATE” (e.g., where it waits for 28 periods of “TxPOHClk_n” to
elapse). Afterwards, the external circuit should exit this “WAIT STATE” and then place the very first bit of
the “outbound” REI-P bit-fields onto the “TxPOH_n” input pin, upon the very next falling edge of
“TxPOHClk_n”. This data bit will be sampled and latched into the “Transmit SONET POH Processor”
block circuitry, upon the very next rising edge of “TxPOHClk_n”
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
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| XRT94L43A | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER |
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