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參數(shù)資料
| 型號： | XRT86VL38IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 70/160頁 |
| 文件大小： | 0K |
| 描述： | IC LIU/FRAMER T1/E1/J1 8CH 420BG |
| 標準包裝： | 40 |
| 控制器類型： | T1/E1/J1 調(diào)幀器，LIU |
| 電源電壓： | 3.3V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 420-BBGA |
| 供應(yīng)商設(shè)備封裝： | 420-PBGA |
| 包裝： | 托盤 |
| 其它名稱： | 1016-1487 XRT86VL38IB-F-ND |
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XRT86VL38
12
REV. V1.2.0
OCTAL T1/E1/J1 FRAMER/LIU COMBO - T1 REGISTER DESCRIPTION
1:0
CSS[1:0]
R/W
01
Clock Source Select
These bits select the timing source for the Transmit T1 Framer block.
These bits can also determine the direction of TxSERCLK, TxSYNC,
and TxMSYNC in base rate operation mode (1.544MHz Clock mode).
In Base Rate (1.544MHz Clock Mode):
TABLE 2: CLOCK SELECT REGISTER(CSR)
HEX ADDRESS: 0Xn100
BIT
FUNCTION
TYPE
DEFAULT
DESCRIPTION-OPERATION
NOTE:
TxSYNC/TxMSYNC can be programmed as input or output
depending on the setting of SYNC INV bit in Register Address
0xn109, bit 4. Please see Register Description for the
Synchronization Mux Register (SMR - 0xn109) Table 10.
NOTES: In High-Speed or multiplexed modes, TxSERCLK, TxSYNC,
and TxMSYNC are all configured as INPUTS only.
CSS[1:0]
TRANSMIT SOURCE FOR THE
TRANSMIT T1 FRAMER BLOCK
DIRECTION OF
TXSERCLK
00/11
Loop Timing Mode
The recovered line clock is cho-
sen as the timing source.
Output
01
External Timing Mode
The Transmit Serial Input Clock
from the TxSERCLK_n input pin is
chosen as the timing source.
Input
10
Internal Timing Mode
The MCLK PLL is chosen as the
timing source.
Output
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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