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參數(shù)資料
| 型號： | XRT86VL38IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 34/160頁 |
| 文件大小： | 0K |
| 描述： | IC LIU/FRAMER T1/E1/J1 8CH 420BG |
| 標準包裝： | 40 |
| 控制器類型： | T1/E1/J1 調幀器，LIU |
| 電源電壓： | 3.3V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 420-BBGA |
| 供應商設備封裝： | 420-PBGA |
| 包裝： | 托盤 |
| 其它名稱： | 1016-1487 XRT86VL38IB-F-ND |
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XRT86VL38
124
REV. V1.2.0
OCTAL T1/E1/J1 FRAMER/LIU COMBO - T1 REGISTER DESCRIPTION
2
FCS ERR ENB
R/W
0
FCS Error Interrupt Enable
This bit enables or disables the “Received FCS Error “Interrupt
within the XRT86VL38 device. Once this interrupt is enabled, the
Receive HDLC3 Controller will generate an interrupt when it has
detected the FCS error within the incoming data link message.
0 = Disables the “Receive FCS Error” interrupt.
1 = Enables the “Receive FCS Error” interrupt.
1
RxABORT ENB
R/W
0
Receipt of Abort Sequence Interrupt Enable
This bit enables or disables the “Receipt of Abort Sequence“ Inter-
rupt within the XRT86VL38 device. Once this interrupt is enabled,
the Receive HDLC3 Controller will generate an interrupt when it has
detected the Abort Sequence (i.e. a string of seven (7) consecutive
1’s) within the incoming data link channel.
0 = Disables the “Receipt of Abort Sequence” interrupt.
1 = Enables the “Receipt of Abort Sequence” interrupt.
0
RxIDLE ENB
R/W
0
Receipt of Idle Sequence Interrupt Enable
This bit enables or disables the “Receipt of Idle Sequence“ Interrupt
within the XRT86VL38 device. Once this interrupt is enabled, the
Receive HDLC3 Controller will generate an interrupt when it has
detected the Idle Sequence Octet (i.e. 0x7E) within the incoming
data link channel.
0 = Disables the “Receipt of Idle Sequence” interrupt.
1 = Enables the “Receipt of Idle Sequence” interrupt.
TABLE 103: DATA LINK INTERRUPT ENABLE REGISTER 3 (DLIER3)
HEX ADDRESS: 0XnB27
BIT
FUNCTION
TYPE
DEFAULT
DESCRIPTION-OPERATION
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PDF描述 |
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