參數(shù)資料
型號(hào)： XC6SLX100T-3FG484I
廠(chǎng)商： Xilinx Inc
文件頁(yè)數(shù)： 64/89頁(yè)
文件大?。?/td> 0K
描述： IC FPGA SPARTAN 6 484FGGBGA
標(biāo)準(zhǔn)包裝： 60
系列： Spartan® 6 LXT
LAB/CLB數(shù)： 7911
邏輯元件/單元數(shù)： 101261
RAM 位總計(jì)： 4939776
輸入/輸出數(shù)： 296
電源電壓： 1.14 V ~ 1.26 V
安裝類(lèi)型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 484-BBGA
供應(yīng)商設(shè)備封裝： 484-FBGA
Spartan-6 FPGA Data Sheet: DC and Switching Characteristics
DS162 (v3.0) October 17, 2011
Product Specification
67
Table 65: Global Clock Input to Output Delay With DCM in Source-Synchronous Mode
Symbol
Description
Device
Speed Grade
Units
-3
-3N
-2
-1L
LVCMOS25 Global Clock Input to Output Delay using Output Flip-Flop, 12mA, Fast Slew Rate, with DCM in Source-Synchronous Mode.
TICKOFDCM_0
Global Clock and OUTFF with DCM
XC6SLX4
5.03
N/A
7.21
8.05
ns
XC6SLX9
5.03
6.13
7.21
8.05
ns
XC6SLX16
5.08
5.51
6.44
7.96
ns
XC6SLX25
4.81
5.13
5.69
7.94
ns
XC6SLX25T
4.81
5.13
5.69
N/A
ns
XC6SLX45
5.26
5.69
6.63
7.92
ns
XC6SLX45T
5.26
5.69
6.63
N/A
ns
XC6SLX75
4.77
5.18
5.88
7.95
ns
XC6SLX75T
4.77
5.18
5.88
N/A
ns
XC6SLX100
4.72
5.11
5.76
8.59
ns
XC6SLX100T
4.76
5.11
5.76
N/A
ns
XC6SLX150
4.90
5.30
5.93
7.93
ns
XC6SLX150T
4.90
5.30
5.93
N/A
ns
XA6SLX4
5.35
N/A
7.21
N/A
ns
XA6SLX9
5.35
N/A
7.21
N/A
ns
XA6SLX16
5.42
N/A
6.44
N/A
ns
XA6SLX25
5.13
N/A
5.69
N/A
ns
XA6SLX25T
5.13
N/A
5.79
N/A
ns
XA6SLX45
5.58
N/A
6.63
N/A
ns
XA6SLX45T
5.58
N/A
6.63
N/A
ns
XA6SLX75
5.09
N/A
5.87
N/A
ns
XA6SLX75T
5.09
N/A
5.87
N/A
ns
XA6SLX100
N/A
6.44
N/A
ns
XQ6SLX75
N/A
5.87
7.95
ns
XQ6SLX75T
5.09
N/A
5.87
N/A
ns
XQ6SLX150
N/A
6.06
7.93
ns
XQ6SLX150T
5.50
N/A
6.06
N/A
ns
Notes:
1.
Listed above are representative values where one global clock input drives one vertical clock line in each accessible column, and where all accessible
IOB and CLB flip-flops are clocked by the global clock net.
2.
DCM output jitter is already included in the timing calculation.
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