參數(shù)資料
型號： UPD78F1235GK-GAJ-AX
廠商： Renesas Electronics America
文件頁數(shù)： 377/1067頁
文件大?。?/td> 0K
描述： MCU 16BIT 78K0R/LX3 64-LQFP
標(biāo)準(zhǔn)包裝： 300
系列： 78K0R/Ix3
核心處理器： 78K/0R
芯體尺寸： 16-位
速度： 40MHz
連通性： 3 線 SIO，I²C，LIN，UART/USART
外圍設(shè)備： DMA，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 50
程序存儲器容量： 64KB（64K x 8）
程序存儲器類型： 閃存
RAM 容量： 3K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 12x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-LQFP
包裝： 托盤
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CHAPTER 7 INVERTER CONTROL FUNCTIONS
User’s Manual U19678EJ1V1UD
375
(19) TAU option mode register (OPMR)
OPMR sets the operation mode of the inverter control function option unit.
OPMR can be rewritten only if HIE1 and HIE0 of the OPCR register are set to 00B and master channels 00
and 04 of TAUS are stopped (TE00 = 0, TE04 = 0).
OPMR can be set by a 16-bit memory manipulation instruction.
Reset signal generation clears this register to 0000H.
Figure 7-10. Format of TAU Option Mode Register (OPMR) (1/2)
Address: F0220H
After reset: 0000H
R/W
Symbol
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
OPMR
OPM HPS HSM HDM
ATS
3
ATS
2
ATS
1
ATS
0
TLS
7
TLS
6
TLS
5
TLS
4
TLS
3
TLS
2
HIS
1
HIS
0
OPM
Operation mode selection
0
6-phase output control mode (TO02 to TO07 become Hi-Z control targets, and Hi-Z control and
cancellation are set by the HDM bit.)
1
Half-bridge output control mode (when channel 0 and channel 4 are the period registers)
(TO02 and TO03 are set to Hi-Z by the TMOFF0 pin or internal comparator CMP0. TO06 and TO07
are set to Hi-Z by the TMOFF1 pin or internal comparator CMP1. A Hi-Z state is cancelled by the
HSM bit.)
HPS
Hi-Z input pin selection
0
Uses the TMOFF0 and TMOFF1 pins as the Hi-Z control signal.
1
Uses the internal comparator output signal as the Hi-Z control signal.
HSM
Hi-Z cancellation method selection (when OPM = 1)
0
A Hi-Z state can be cancelled in synchronization with the period after the inactive edge of an internal
comparator (CMP0/CMP1) or TMOFF0, TMOFF1 is detected.
1
A Hi-Z state can be cancelled in synchronization with the period after the edge by a software write is
detected.
HDM
Hi-Z cancellation method selection (when OPM = 0)
0
2-stage overcurrent detection mode
(A Hi-Z state is set when the active edge of internal comparator 0 (CMP0 side) or TMOFF0 is
detected, and the Hi-Z state is cancelled in synchronization with the period after an inactive edge is
detected. Furthermore, a Hi-Z state is set when the active edge of internal comparator 1 (CMP1
side) or TMOFF1 is detected, and the Hi-Z state is cancelled in synchronization with the period after
the edge by a software write is detected.)
1
Overcurrent/electromotive force detection mode
(A Hi-Z state is set by reversing the internal comparator 0 output or reversing the TMOFF0 active
edge detection, and thus detecting the overcurrent side (high-potential CMP1 or TMOFF1) and the
electromotive force side (low-potential CMP0 or TMOFF0). The Hi-Z state can be cancelled in
synchronization with the period after inactive edge detection of an internal comparator or TMOFF0,
TMOFF1.)
Caution
There is no TMOFF1 pin in the 78K0R/IB3.
Consequently, in the 78K0R/IB3, high
impedance cannot be controlled by using the TMOFF1 pin.
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PDF描述
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UPD78F9212CS-CAB-A MCU 8BIT 4KB FLASH 16PIN
UPD78F9222CS-CAC-A MCU 8BIT 4KB FLASH 20PIN
UPD78F9234CS-CAA-A MCU 8BIT 8KB FLASH 30PIN
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