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參數(shù)資料
| 型號(hào)： | TMX320DM6437BZWTA |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media Processor |
| 中文描述： | 數(shù)字媒體處理器 |
| 文件頁(yè)數(shù)： | 102/309頁(yè) |
| 文件大小： | 2216K |
| 代理商： | TMX320DM6437BZWTA |
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www.ti.com
P
TMS320DM6437
Digital Media Processor
SPRS345B–NOVEMBER 2006–REVISED MARCH 2007
The device is divided into the following Pin Multiplexed Blocks (Pin Mux Blocks):
EMIFA/VPSS Block:
VPSS (VPFE/VPBE), EMIFA, part of PCI, GPIO. This block is further subdivided
into these sub-blocks:
–
Sub-Block 0:
VPFE (CCDC), part of EMIFA (data, address, control), part of PCI, and GPIO
–
Sub-Block 1:
VPBE (VENC), part of EMIFA (data, address, control), and GPIO
–
Sub-Block 2:
part of EMIFA (control signals EM_WAIT/(RDY/BSY), EM_OE, and EM_WE)
–
Sub-Block 3:
part of EMIFA (address EM_A[12:5]), part of PCI, and GPIO
Host Block:
HPI, VLYNQ, EMAC, part of PCI, and GPIO
PCI Data Block:
part of PCI
GPIO Block:
part of PCI and GPIO
Serial Port Block:
McBSP0, McBSP1, McASP0, and GPIO. This block is further sub-divided into
sub-blocks.
–
Serial Port Sub-Block 0:
McBSP0, part of McASP0, and GPIO
–
Serial Port Sub-Block 1:
McBSP1, part of McASP0, and GPIO
UART0 Flow Control Block:
UART0 flow control, PWM0, and GPIO
UART0 Data Block:
UART0 data and GPIO
Timer0 Block:
Timer0 and McBSPs’ CLKS pins
Timer1 Block:
Timer1 and HECC, UART1 data
PWM1 Block:
PWM1 and GPIO
CLKOUT Block:
CLKOUT0, PWM2, and GPIO
As shown in the list above, the PCI, McBSP0, McBSP1, and UART0 peripherals span multiple Pin Mux
Blocks. To use these peripherals, they must be selected in all relevant Pin Mux Blocks. For more details,
see
Section 3.7.3
,
Pin Multiplexing Details
, and
Section 3.7.3.2
,
Peripherals Spanning Multiple Pin Mux
Blocks
.
Note:
there is no actual pin multiplexing in EMIFA/VPSS Sub-Block 2 and the PCI Data Block. However
these are still considered "pin mux blocks" because they contain part of the pins necessary for EMIFA and
PCI, respectively.
A high level view of the Pin Mux Blocks is shown in
Figure 3-11
. In each Pin Mux Block, the
PINMUX0/PINMUX1 default settings are underlined.
Note:
some default pin functions are determined by configuration pins (PCIEN, AEAW[2:0], AEM[2:0]);
therefore, more than one configuration setting can serve as default based on the configuration pin settings
latched at device reset.
Device Configurations
102
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