參數(shù)資料
型號： TMS320LC542-40
元件分類： 數(shù)字信號處理
英文描述： Digital Signal Processor
中文描述： 數(shù)字信號處理器
文件頁數(shù)： 99/111頁
文件大?。?/td> 1426K
代理商： TMS320LC542-40
TMS320C54x, TMS320LC54x, TMS320VC54x
FIXED-POINT DIGITAL SIGNAL PROCESSORS
SPRS039C – FEBRUARY 1996 – REVISED DECEMBER 1999
99
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
serial-port transmit timing in TDM mode
switching characteristics over recommended operating conditions for serial-port transmit in TDM
mode [H = 0.5t
c(CO)
] (see Figure 39)
PARAMETER
’542
’543
’C54x-40
’LC54x-40
’LC54x-50
UNIT
MIN
MAX
MIN
MAX
th(TCH-TDV)
th(TCH-TDV)
Hold time, TDAT/TADD valid after TCLK rising edge, TCLK external
3
0
ns
Hold time, TDAT/TADD valid after TCLK rising edge, TCLK internal
Delay time, TFRM valid after TCLK rising edge TCLK ext
Delay time, TFRM valid after TCLK rising edge, TCLK int
Delay time, TCLK to valid TDAT/TADD, TCLK ext
1
– 5
ns
td(TCH-TFV)
H – 3
3H + 22
H – 3
3H + 22
ns
H – 3
3H + 12
H – 3
3H + 12
td(TC TDV)
td(TC-TDV)
18
25
ns
Delay time, TCLK to valid TDAT/TADD, TCLK int
18
18
TFRM timing and waveforms shown in Figure 39 are for internal TFRM. TFRM can also be configured as external. The TFRM external case is
illustrated in the receive timing diagram in Figure 38.
switching characteristics over recommended operating conditions for serial-port transmit in TDM
mode [H = 0.5t
c(CO)
] (see Figure 39)
PARAMETER
’54x-66
UNIT
MIN
MAX
th(TCH-TDV)
th(TCH-TDV)
Hold time, TDAT/TADD valid after TCLK rising edge, TCLK external
1
ns
Hold time, TDAT/TADD valid after TCLK rising edge, TCLK internal
Delay time, TFRM valid after TCLK rising edge, TCLK ext
Delay time, TFRM valid after TCLK rising edge, TCLK int
Delay time, TCLK to valid TDAT/TADD, TCLK ext
1
ns
td(TCH-TFV)
H – 3
3H+22
ns
H – 3
3H+12
25
td(TC TDV)
td(TC-TDV)
ns
Delay time, TCLK to valid TDAT/TADD, TCLK int
TFRM timing and waveforms shown in Figure 39 are for internal TFRM. TFRM can also be configured as external. The TFRM external case is
illustrated in the receive timing diagram in Figure 38.
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