參數(shù)資料
型號： TMS320LC542-40
元件分類： 數(shù)字信號處理
英文描述： Digital Signal Processor
中文描述： 數(shù)字信號處理器
文件頁數(shù)： 67/111頁
文件大小： 1426K
代理商： TMS320LC542-40
TMS320C54x, TMS320LC54x, TMS320VC54x
FIXED-POINT DIGITAL SIGNAL PROCESSORS
SPRS039C – FEBRUARY 1996 – REVISED DECEMBER 1999
67
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
multiply-by-N clock option – PLL enabled (continued)
timing requirements for multiply-by-N clock option – PLL enabled (see Figure 15)
’C54x-40
’LC54x-40
’LC54x-50
’54x-66
UNIT
MIN
20
20
20
MAX
400
MIN
20
20
20
MAX
400
MIN
20
20
20
MAX
400
Integer PLL multiplier N (N = 1–15)
tc(CI)
Cycle time, X2/CLKIN
PLL multiplier N = x.5
200
200
200
ns
PLL multiplier N = x.25, x.75
100
100
100
tf(CI)
tr(CI)
tw(CIL)
tw(CIH)
Note that for all values of tc(CI), the minimum tc(CO) period must not be exceeded.
Fall time, X2/CLKIN
4
4
4
ns
Rise time, X2/CLKIN
4
4
4
ns
Pulse duration, X2/CLKIN low
5
5
5
ns
Pulse duration, X2/CLKIN high
5
5
5
ns
tc(CO)
tc(CI)
tw(COH)
tf(CO)
tr(CO)
tf(CI)
X2/CLKIN
CLKOUT
td(CIH-CO)
tw(COL)
tr(CI)
tp
Unstable
tw(CIH)
tw(CIL)
Figure 15. External Multiply-by-One Clock Timing
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PDF描述
TMS320LC542-50 Digital Signal Processor
TMS320UVC5409 16-Bit Digital Signal Processor
TMS320UVC5402 Fixed-Point Digital Signal Processor(定點DSP)
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