參數資料
型號： TMS320LC542-40
元件分類： 數字信號處理
英文描述： Digital Signal Processor
中文描述： 數字信號處理器
文件頁數： 58/111頁
文件大?。?/td> 1426K
代理商： TMS320LC542-40
TMS320C54x, TMS320LC54x, TMS320VC54x
FIXED-POINT DIGITAL SIGNAL PROCESSORS
SPRS039C – FEBRUARY 1996 – REVISED DECEMBER 1999
58
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
electrical characteristics and operating conditions — ’C541, ’C542 (continued)
electrical characteristics over recommended operating case temperature range (unless otherwise
noted)
PARAMETER
TEST CONDITIONS
IOH = –300
μ
A
MIN
TYP
MAX
UNIT
VOH
High-level output voltage
2.4
V
VOL
IIZ
Low-level output voltage
IOL = 2 mA
VDD = MAX,
With internal pulldown
0.6
V
μ
A
μ
A
Input current in high impedance
VI = VSS to VDD
–20
20
TRST
–10
800
Input current
(VI= VSSto VDD)
(VI = VSS to VDD)
HPIENA
TMS, TCK, TDI, HPI||
With internal pulldown, RS = 0
–10
400
II
With internal pullups
–500
10
D[15:0], HD[7:0]
Bus holders enabled, VDD = MAX
–150
250
μ
A
All other input-only pins
–10
10
IDDC
IDDP
Supply current, core CPU
VDD = 5 V, fx = 40 MHz,§TC = 25
°
C
VDD = 5 V, fx = 40 MHz,§TC = 25
°
C
PLL
×
1 mode,
40 MHz input
47
18#
mA
Supply current, pins
mA
IDD
Supply current standby
Supply current, standby
IDLE2
4
mA
IDLE3
Divide-by-two mode, CLKIN stopped
5
μ
A
Ci
Co
All typical values are at VDD = 5 V, TC = 25
°
C.
All input and output voltage levels except RS, INT0–INT3, NMI, CNT, X2/CLKIN, CLKMD0–CLKMD3 are TTL-compatible.
§Clock mode: PLL
×
1 with external source
This value was obtained with 50% usage of MAC and 50% usage of NOP instructions. Actual operating current varies with program being
executed.
#This value was obtained with single-cycle external writes, CLKOFF = 0 and load = 15 pF. For more details on how this calculation is performed,
refer to the Calculation of TMS320C54x Power Dissipationapplication report (literature number SPRA164).
||HPI input signals except for HPIENA.
VIL(MIN)
≤
VI
≤
VIL(MAX) or VIH(MIN)
≤
VI
≤
VIH(MAX)
Input capacitance
10
pF
Output capacitance
10
pF
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