- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄373631 > TFRA08C13 (Lineage Power) Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 PDF資料下載
參數(shù)資料
| 型號(hào)： | TFRA08C13 |
| 廠商： | Lineage Power |
| 元件分類(lèi)： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁(yè)數(shù)： | 9/188頁(yè) |
| 文件大?。?/td> | 3047K |
| 代理商： | TFRA08C13 |
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Lucent Technologies Inc.
9
Preliminary Data Sheet
October 2000
TFRA08C13 OCTAL T1/E1 Framer
Table of Contents
(continued)
Tables
Page
Table 167. FDL Interrupt Mask Control Register (FDL_PR2) (A02; A22; B02; B22; C02; C22; D02; D22) .........170
Table 168. FDL Transmitter Configuration Control Register (FDL_PR3)
(A03; A23; B03; B23; C03; C23; D03; D23).......................................................................................................171
Table 169. FDL Transmitter FIFO Register (FDL_PR4) (A04; A24; B04; B24; C04; C24; D04; D24) ..................171
Table 170. FDL Transmitter Idle Character Mask Register (FDL_PR5)
(A05; A25; B05; B25; C05; C25; D05; D25).......................................................................................................171
Table 171. FDL Receiver Interrupt Level Control Register (FDL_PR6)
(A06; A26; B06; B26; C06; C26; D06; D26).......................................................................................................172
Table 172. FDL Register FDL_PR7......................................................................................................................172
Table 173. FDL Receiver Match Character Register (FDL_PR8) (A08; A28; B08; B28; C08; C28; D08; D28) ...172
Table 174. FDL Transparent Control Register (FDL_PR9) (A09; A29; B09; B29; C09; C29; D09; D29)..............173
Table 175. FDL Transmit ANSIESF Bit Codes (FDL_PR10) (A0A; A2A; B0A; B2A; C0A; C2A; D0A; D2A).......173
Table 176. FDL Interrupt Status Register (Clear on Read) (FDL_SR0)
(A0B; A2B; B0B; B2B; C0B; C2B; D0B; D2B) ...................................................................................................174
Table 177. FDL Transmitter Status Register (FDL_SR1) (A0C; A2C; B0C; B2C; C0C; C2C; D0C; D2C) ...........175
Table 178. FDL Receiver Status Register (FDL_SR2) (A0D; A2D; B0D; B2D; C0D; C2D; D0D; D2D) ..............175
Table 179. Receive ANSI FDL Status Register (FDL_SR3) (A0E; A2E; B0E; B2E; C0E; C2E; D0E; D2E) ........175
Table 180. FDL Receiver FIFO Register (FDL_SR4) (A07; A27; B07; B27; C07; C27; D07; D27)......................175
Table 181. Global Register Set.............................................................................................................................176
Table 182. Framer Unit Status Register Map .......................................................................................................177
Table 183. Receive Signaling Registers Map.......................................................................................................179
Table 184. Framer Unit Parameter Register Map.................................................................................................180
Table 185. Transmit Signaling Registers Map ......................................................................................................183
Table 186. Facility Data Link Register Map ..........................................................................................................184
Table 187. ESD Threshold Voltage.......................................................................................................................185
Table 188. Logic Interface Characteristics (T
A
= –40 °C to +85 °C, V
DD
= 3.3 V ± 5%, V
SS
= 0).........................186
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