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參數(shù)資料
| 型號(hào)： | TFRA08C13 |
| 廠商： | Lineage Power |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁(yè)數(shù)： | 159/188頁(yè) |
| 文件大?。?/td> | 3047K |
| 代理商： | TFRA08C13 |
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Lucent Technologies Inc.
159
Preliminary Data Sheet
October 2000
TFRA08C13 OCTAL T1/E1 Framer
Framer Register Architecture
(continued)
Table 147. Framer Exercises, FRM_PR42 Bit 5—Bit 0 (Y8A)
(continued)
DS1 System Interface Control and CEPT FDL Source Control Register (FRM_PR43)
The default value of this register is 00 (hex).
Table 148. DS1 System Interface Control and CEPT FDL Source Control Register (FRM_PR43) (Y8B)
Exercise Type
FEX5 FEX4 FEX3
FEX2
FEX1
FEX0
Exercise
Framing
Format
All
Performance
Status
0
0
0
0
0
0
0
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
0
0
0
1
1
1
0
0
1
1
0
0
1
0
1
0
1
0
1
0
Errored second
Bursty errored second
Severely errored second
Severely errored second count
Unavailable state
Factory test
Increment status counters
SR6—SR14
Increment status counters
SR6—SR14
CRC error counter
Errored event counter
Errored second counter
Severely errored second counter
Unavailable second counter
Line format violation counter
Frame bit error counter
Reserved
0
1
0
1
1
1
Status Counters
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
0
X
0
0
0
0
0
0
0
1
1
1
1
0
1
1
0
0
1
1
1
0
1
0
1
0
1
All
—
All other combinations
—
Bit
0—2
Symbol
STS0—STS2 In DS1 mode, bit 0—bit 2 program the positions of the stuffed time slots on the CHI. The
content of the stuffed time slot can be programmed using register FRM_PR23.
Bits
210
000 = SDDDSDDDSDDDSDDDSDDDSDDDSDDDSDDD
001 = DSDDDSDDDSDDDSDDDSDDDSDDDSDDDSDD
010 = DDSDDDSDDDSDDDSDDDSDDDSDDDSDDDSD
011 = DDDSDDDSDDDSDDDSDDDSDDDSDDDSDDDS
100 = DDDDDDDDDDDDDDDDDDDDDDDDSSSSSSSS
SaFDL0—
SaFDL2
Bits
210
000: Sa4 = FDL
001: Sa5 = FDL
010: Sa6 = FDL
011: Sa7 = FDL
100: Sa8 = FDL
In both DS1 and CEPT modes, only the bit values shown above may be selected.
SSC
SLC-96 Signaling Control (DS1 Only).
A 1 enables the SLC-96 9-state signaling mode.
A 0 enables 16-state signaling in the SLC-96 framing mode.
—
Reserved.
Write to 0.
Description
In CEPT mode, bit 0—bit 2 program the Sa-bit source of the facility data link.
3
4—7
相關(guān)PDF資料 |
PDF描述 |
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| TFT0675S | Anti-Aliasing and Reconstruction TFT range |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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