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參數(shù)資料
| 型號： | TC9324F |
| 廠商： | Toshiba Corporation |
| 英文描述： | Single-Chip DTS Microcontroller (DTS-20) |
| 中文描述： | 單芯片微丘（丘- 20） |
| 文件頁數(shù)： | 40/101頁 |
| 文件大?。?/td> | 1831K |
| 代理商： | TC9324F |
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TC9324F
2002-02-08
40
2. Timer-Counter Function
The timer-counter consists of an 8-bit binary counter, a counter match register, a digital comparator, and
the control circuits to run these.
The timer-counter inputs a timer clock to an 8-bit binary counter. When the count of the 8-bit binary
counter matches the contents of the counter match register, the timer-counter outputs a match signal pulse
and generates an interrupt request. The timer-counter can be reset by the match pulse or by software.
The reset by match pulse can be enabled or disabled. INTR1/2 input, an instruction cycle, or a frequency of
1 kHz can be selected as a timer clock.
(1)
Timer-counter register structure
The timer-counter registers consist of the counter data, a match register, and a control register.
Note: When using the timer-counter, the IE bit must be set to 1.
CK0
CK1
CPU clock
Timer clock
0
0
*
INTR1 pin input
4.5 MHz
562.5 kHz
0
1
75 kHz
Instruction
cycle clock
25 kHz
1
0
*
25 kHz
1
1
*
1 kHz
φ
L15P2
Y1
Y2
Y4
Y8
ID0
ID1
ID2
ID3
Timer-counter match data
φ
L16P2
Y1
Y2
Y4
Y8
ID4
ID5
ID6
ID7
0: Counts on rising edge.
1: Counts on falling edge.
Y1
Y2
Y4
Y8
φ
L17P2
CK0
CK1
GT
CR
Timer clock selection
Outputs a match pulse at a match with the timer-counter
φ
K15P2
Y1
Y2
Y4
Y8
CT0
CT1
CT2
CT3
Timer-counter data
φ
K16P2
Y1
Y2
Y4
Y8
CT4
CT5
CT6
CT7
The timer-counter data are read in binary to the data memory
as-are.
Timer-counter reset
Resets counter whenever 1 is set.
Enables counter reset by match pulse
0: Enabled
1: Disabled
The clock edge can be selected by the POL bit
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