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參數(shù)資料
| 型號： | STSAM9708 |
| 廠商： | Atmel Corp. |
| 英文描述： | Sound Synthesis |
| 中文描述： | 聲音合成 |
| 文件頁數(shù)： | 11/30頁 |
| 文件大?。?/td> | 373K |
| 代理商： | STSAM9708 |
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11
ATSAM9708
1772D–DRMSD–01/04
Timing Diagrams
All timing conditions: V
CC
= 5V, V
C3
= 3.3V, t
A
= 25°C; signals
PC_READY
, I/O CS16,
D0 - D15 with 220 ohms pull-up, 30 pF capacitance; signal PC_IRQ with 470 ohms pull-
down, 30 pF capacitance; all other outputs except X2 and LFT load capacitance = 30
pF. All timings refer to t
CK
, which is the internal master clock period. The internal master
clock frequency is 4 times the frequency at pin X1; therefore, t
CK
= t
XTAL
/4. The sampling
rate is given by 1/(t
CK
* 1024). The maximum crystal frequency/clock frequency at X1 is
12.288 MHz (48 kHz sampling rate).
PC Host Interface
Figure 3.
Host Interface Read Cycle
Note:
PC_D[15:8] valid only if PC_A[2:1] = 10.
Figure 4.
Host Interface Write Cycle
Note:
PC_D[15:8] valid only if PC_A[2:1] = 10.
PC_A[2:0]
PC_CS
PC_RD
PC_ READY
PC_IO16
PC_D[15:0]
t
AVCS
t
CSLRDL
t
PRD
t
RDHCSB
t
RDLIORL
t
PIOR
t
CSLIOCS
t
IORHDV
t
CSHIOCS
t
RDLDV
t
RDH
t
AVCS
t
CSLWRL
t
PWR
t
WRHCSB
t
WRLIORL
t
PIOR
t
CSLIOCS
t
IORHWRH
t
CSHIOCS
t
DWS
t
DWB
PC_A[2:0]
PC_CS
PC_WR
PC_ READY
PC_IO16
PC_D[15:0]
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PDF描述 |
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