參數(shù)資料
型號(hào)： STA323WTR
廠商： 意法半導(dǎo)體
英文描述： 2.1 HIGH EFFICIENCY DIGITAL AUDIO SYSTEM
中文描述： 2.1高效率數(shù)字音頻系統(tǒng)
文件頁(yè)數(shù)： 15/41頁(yè)
文件大?。?/td> 749K
代理商： STA323WTR
15/41
STA323W
Table 10. Supported Serial Audio Input Formats
Table 11. Serial Input Data Timing characteristics (Fs = 32 to 192kHz)
BICKI
SAI (3...0)
SAIFB
Interface Format
32fs
1100
X
I
2
S 15bit Data
1110
X
Left/Right-Justified 16bit Data
48fs
0100
X
I
2
S 23bit Data
0100
X
I
2
S 20bit Data
1000
X
I
2
S 18bit Data
0100
0
MSB First I
2
S 16bit Data
1100
1
LSB First I
2
S 16bit Data
0001
X
Left-Justified 24bit Data
0101
X
Left-Justified 20bit Data
1001
X
Left-Justified 18bit Data
1101
X
Left-Justified 16bit Data
0010
X
Right-Justified 24bit Data
0110
X
Right-Justified 20bit Data
1010
X
Right-Justified 18bit Data
1110
X
Right-Justified 16bit Data
64fs
0000
X
I
2
S 24bit Data
0100
X
I
2
S 20bit Data
1000
X
I
2
S 18bit Data
0000
0
MSB First I
2
S 16bit Data
1100
1
LSB First I
2
S 16bit Data
0001
X
Left-Justified 24bit Data
0101
X
Left-Justified 20bit Data
1001
X
Left-Justified 18bit Data
1101
X
Left-Justified 16bit Data
0010
X
Right-Justified 24bit Data
0110
X
Right-Justified 20bit Data
1010
X
Right-Justified 18bit Data
1110
X
Right-Justified 16bit Data
BICKI FREQUENCY (slave mode)
12.5MHz max.
BICKI pulse width low (T0) (slave mode)
40 ns min.
BICKI pulse width high (T1) (slave mode)
40 ns min.
BICKI active to LRCKI edge delay (T2)
20 ns min.
BICKI active to LRCKI edge delay (T3)
20 ns min.
SDI valid to BICKI active setup (T4)
20 ns min.
BICKI active to SDI hold time (T5)
20 ns min.
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