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參數(shù)資料
| 型號： | SII3114_07 |
| 廠商： | Silicon Image, Inc. |
| 英文描述： | PCI to Serial ATA Controller |
| 中文描述： | PCI到Serial ATA控制器 |
| 文件頁數(shù)： | 43/127頁 |
| 文件大小： | 598K |
| 代理商： | SII3114_07 |
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SiI
3114 PCI to Serial ATA Controller
Data Sheet
Silicon Image, Inc.
2007 Silicon Image, Inc.
35
SiI
-DS-0103-D
PRD Table Address – Channel 0/2
Address Offset: 74
H
Access Type: Read/Write
Reset Value: 0x0000_0000
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10 09 08 07 06 05 04 03 02 01 00
PRD Table Address – Channel 0/2
R
This register defines the PRD Table Address register for Channel 0/2 in the
SiI
3114. The register bits are also
mapped to Base Address 4, Offset 04
H
and Base Address 5, Offset 04
H
. See “PRD Table Address – Channel
X
”
section on page 54 for bit definitions.
PCI Bus Master – Channel 1/3
Address Offset: 78
H
Access Type: Read/Write
Reset Value: 0x0000_0000
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10 09 08 07 06 05 04 03 02 01 00
Reserved
P
P
P
R
D
P
P
Reserved
Reserved
P
R
P
This register defines the PCI bus master register for Channel 1/3 in the
SiI
3114. The register bits are also
mapped to Base Address 4, Offset 08
H
, Base Address 5, Offset 08
H
, and Base Address 5, Offset 18
H
(Note that
these registers are, however, not identical). See “PCI Bus Master – Channel
X
” section on page 53 for bit
definitions.
PRD Table Address – Channel 1/3
Address Offset: 7C
H
Access Type: Read/Write
Reset Value: 0x0000_0000
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10 09 08 07 06 05 04 03 02 01 00
PRD Table Address – Channel 1/3
R
This register defines the PRD Table Address register for Channel 1/3 in the
SiI
3114. The register bits are also
mapped to Base Address 4, Offset 0C
H
and Base Address 5, Offset 0C
H
. See “PRD Table Address – Channel
X
”
section on page 54 for bit definitions.
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PDF描述 |
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