參數(shù)資料
型號(hào)： SC16C752
廠商： NXP Semiconductors N.V.
英文描述： Dual UART with 64-byte FIFO
中文描述： 雙UART具有64字節(jié)FIFO
文件頁數(shù)： 29/47頁
文件大?。?/td> 604K
代理商： SC16C752
Philips Semiconductors
SC16C752
Dual UART with 64-byte FIFO
Product data
Rev. 04 — 20 June 2003
29 of 47
9397 750 11635
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
7.14 FIFO ready register
The FIFO ready register provides real-time status of the transmit and receive FIFOs
of both channels.
The FIFO Rdy register is a read-only register that can be accessed when any of the
two UARTs is selected CSA or CSB = 0, MCR[2] (FIFO Rdy Enable) is a logic 1, and
loop-back is disabled. The address is 111.
Table 22:
Bit
7-6
5
4
3-2
1
0
FIFO Ready Register bits description
Symbol
Description
FIFO Rdy[7:6]
Unused; always 0.
FIFO Rdy[5]
RX FIFO B status. Related to DMA.
FIFO Rdy[4]
RX FIFO A status. Related to DMA.
FIFO Rdy[3:2]
Unused; always 0.
FIFO Rdy[1]
TX FIFO B status. Related to DMA.
FIFO Rdy[0]
TX FIFO A status. Related to DMA.
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PDF描述
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