- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄365431 > S6D0114 (SAMSUNG SEMICONDUCTOR CO. LTD.) 132 RGB X 176 DOT 1-CHIP DRIVER IC WITH INTERNAL GRAM FOR 262,144 Colors TFT-LCD PDF資料下載
參數(shù)資料
| 型號： | S6D0114 |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | 132 RGB X 176 DOT 1-CHIP DRIVER IC WITH INTERNAL GRAM FOR 262,144 Colors TFT-LCD |
| 中文描述： | 132的RGB × 176交通部1 -芯片驅(qū)動器集成電路的26萬色TFT內(nèi)部革蘭氏液晶顯示器 |
| 文件頁數(shù)： | 17/143頁 |
| 文件大?。?/td> | 1919K |
| 代理商： | S6D0114 |
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S6D0114 132-RGB X 176-DOT 1-CHIP DRIVER IC FOR 262,144-COLOR TFT-LCD DISPLAY
Preliminary
17
DISPLAY PIN
Table 8. Display pin description
Symbol
I/O
Description
S1 - S396
O
Source driver output pins.
The SS bit can change the shift direction of the source signal.
For example, if SS = 0, gray data of S1 is read from RAM address 0000h.
If SS = 1, contents of is RAM address 0000h is out from S396.
S1, S4, S7, ... S(3n-1) : display Red (R) (SS = 0)
S2, S5, S8, ... S(3n-2) : display Green (G) (SS = 0)
S3, S6, S9, ... S(3n) : display Blue (B) (SS = 0)
Gate driver output pins.
The output of driving circuit is whether VGH or Vgoff.
VGH : gate-ON level
Vgoff : gate-OFF level
G1 - G176
O
G0,
G177
O
Gate driver output pins for IC maker’ s testing.
Please, leave it disconnected.
CL1
O
Output pin for raster-row clock pulse.
M
O
Output pin for AC-cycle signal.
FLM
O
Output pin for frame-start pulse.
EQ
O
Output pin for timing for equalizing.
Low : Normal display, High : Equalizing
DISPTMG
O
Output pin for Gate off signal.
High : Normal output
Low : Non-display
MISCELLANEOUS CONTROL PIN
Table 9. Oscillator and internal power regulator pin description
Symbol
OSC1/
OSC2
I/O
Description
I/O
Connect an external resistor for R-C oscillation.
When input the clock from outside, input to OSC1, and open OSC2.
PregB
I
Internal power regulator control input pin.
When the internal regulated power (RDVDD) is used as VDD, PregB is fixed to “l(fā)ow” level.
When the external logic power(VDD3) is used as VDD, PregB is fixed to “high” level.
RDVDD
O
Internal power regulated-VDD output (typ. 1.8V).
When PregB is “l(fā)ow”, RDVDD is connected to VDD pin. When PRegB is “high”, leave this
pin open.
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