- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄365431 > S6D0114 (SAMSUNG SEMICONDUCTOR CO. LTD.) 132 RGB X 176 DOT 1-CHIP DRIVER IC WITH INTERNAL GRAM FOR 262,144 Colors TFT-LCD PDF資料下載
參數(shù)資料
| 型號(hào)： | S6D0114 |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | 132 RGB X 176 DOT 1-CHIP DRIVER IC WITH INTERNAL GRAM FOR 262,144 Colors TFT-LCD |
| 中文描述： | 132的RGB × 176交通部1 -芯片驅(qū)動(dòng)器集成電路的26萬色TFT內(nèi)部革蘭氏液晶顯示器 |
| 文件頁數(shù)： | 16/143頁 |
| 文件大小： | 1919K |
| 代理商： | S6D0114 |
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132-RGB X 176-DOT 1-CHIP DRIVER IC FOR 262,144-COLOR TFT-LCD DISPLAY
S6D0114
Preliminary
16
Table 7. System interface pin description (Continued)
DB1/SDO
I/O
Bi-directional data bus.
18-bit interface : DB 17-0
16-bit interface : DB 17-10, DB 8-1
9-bit interface : DB 17-9
8-bit interface : DB 17-10
Fix DB1 to the VDD3 or VSS level if the pin is not in use.
For a serial peripheral interface (SPI), serves as the serial data output pin (SDO).
Successive bits are output at the falling edge of the SCL signal.
DB17-DB2
I/O
Bi-directional data bus.
18-bit interface : DB 17-0
16-bit interface : DB 17-10, DB 8-1
9-bit interface : DB 17-9
8-bit interface : DB 17-10
Fix unused pin to the VDD3 or VSS level.
Data input valid signal when GRAM is written:
CSB
VLD
0
0
0
1
1
*
GRAM write
Valid
Invalid
Invalid
GRAM address
Update
Update
Storage
VLD
I
Fix VLD pin at VSS level if the pin is not used.
Data enable signal pin for RGB interface.
High: the IC can be access via RGB interface.
Low: the IC cannot be access via RGB interface
ENABLE
VLD
1
0
1
1
0
*
Fix ENABLE pin at VDD3 level if the pin is not used.
GRAM write
Valid
Invalid
Invalid
GRAM address
Update
Update
Storage
ENABLE
I
VSYNC
I
Synchronous signal of frame.
Low: active
Fix VSYNC pin at VDD3 level if the pin is not used.
HSYNC
I
Synchronous signal of line.
Low: active
Fix HSYNC pin at VDD3 level if the pin is not used.
DOTCLK
I
Input pin for dot clock.
RGB data input bus.
18-bit interface : PD 17-0
16-bit interface : PD 17-13, PD 11-1
6-bit interface : PD 17-12
Fix unused pin to the VDD3 or VSS level.
PD17-PD0
I
PDSB
I
RGB and SYSTEM interface hold DB17-0 pin in common as a data input pin when PDSB
pin is “l(fā)ow”.
RESETB1/
RESETB2/
RESETB3
I
Reset pin. Initializes the LSI when low. Must be reset after power-on.
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