參數(shù)資料
型號(hào)： R5F61664RN50FPV
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, RISC MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-144
文件頁(yè)數(shù)： 7/70頁(yè)
文件大?。?/td> 8775K
代理商： R5F61664RN50FPV
Rev. 1.00 Feb. 18, 2008 Page xv of xxxii
8.10.13
DRAM Interface and Single Address Transfer by DMAC and EXDMAC ...... 289
8.11
Synchronous DRAM Interface ......................................................................................... 292
8.11.1
Setting SDRAM space ...................................................................................... 292
8.11.2
Address Multiplexing........................................................................................ 293
8.11.3
Data Bus............................................................................................................ 293
8.11.4
I/O Pins Used for DRAM Interface .................................................................. 294
8.11.5
Basic Timing..................................................................................................... 295
8.11.6
CAS Latency Control........................................................................................ 297
8.11.7
Controlling Row Address Output Cycle ........................................................... 299
8.11.8
Controlling Precharge Cycle............................................................................. 301
8.11.9
Controlling Clock Suspend Insertion ................................................................ 303
8.11.10
Controlling Write-Precharge Delay .................................................................. 304
8.11.11
Controlling Byte and Word Accesses ............................................................... 305
8.11.12
Fast-Page Access Operation ............................................................................. 307
8.11.13
Refresh Control................................................................................................. 313
8.11.14
Setting SDRAM Mode Register ....................................................................... 321
8.11.15
SDRAM Interface and Single Address Transfer by DMAC and EXDMAC .... 322
8.11.16
EXDMAC Cluster Transfer .............................................................................. 330
8.12
Idle Cycle.......................................................................................................................... 333
8.12.1
Operation .......................................................................................................... 333
8.12.2
Pin States in Idle Cycle ..................................................................................... 345
8.13
Bus Release....................................................................................................................... 346
8.13.1
Operation .......................................................................................................... 346
8.13.2
Pin States in External Bus Released State......................................................... 347
8.13.3
Transition Timing ............................................................................................. 348
8.14
Internal Bus....................................................................................................................... 350
8.14.1
Access to Internal Address Space ..................................................................... 350
8.15
Write Data Buffer Function .............................................................................................. 351
8.15.1
Write Data Buffer Function for External Data Bus........................................... 351
8.15.2
Write Data Buffer Function for Peripheral Modules ........................................ 352
8.16
Bus Arbitration .................................................................................................................353
8.16.1
Operation .......................................................................................................... 353
8.16.2
Bus Transfer Timing ......................................................................................... 354
8.17
Bus Controller Operation in Reset .................................................................................... 357
8.18
Usage Notes ...................................................................................................................... 357
Section 9 DMA Controller (DMAC) .................................................................361
9.1
Features............................................................................................................................. 361
9.2
Input/Output Pins.............................................................................................................. 364
9.3
Register Descriptions ........................................................................................................ 365
相關(guān)PDF資料
PDF描述
R5F61664RN50BGV 32-BIT, FLASH, RISC MICROCONTROLLER, PBGA176
R5F64110DFB 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP100
R5F64114DFB 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP100
R5F6411ENFN 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP64
R5F6411FDFN 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP64
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參數(shù)描述
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