參數(shù)資料
型號(hào)： R5F61664RN50FPV
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, RISC MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-144
文件頁(yè)數(shù)： 19/70頁(yè)
文件大?。?/td> 8775K
代理商： R5F61664RN50FPV
Rev. 1.00 Feb. 18, 2008 Page xxvi of xxxii
19.6
Processing of USB Standard Commands and Class/Vendor Commands ....................... 1006
19.6.1
Processing of Commands Transmitted by Control Transfer ........................... 1006
19.7
Stall Operations .............................................................................................................. 1007
19.7.1
Overview ........................................................................................................ 1007
19.7.2
Forcible Stall by Application .......................................................................... 1007
19.7.3
Automatic Stall by USB Function Module ..................................................... 1009
19.8
DMA Transfer ................................................................................................................ 1010
19.8.1
Overview ........................................................................................................ 1010
19.8.2
DMA Transfer for Endpoint 1 ........................................................................ 1010
19.8.3
DMA Transfer for Endpoint 2 ........................................................................ 1011
19.9
Example of USB External Circuitry ............................................................................... 1012
19.10 Usage Notes .................................................................................................................... 1014
19.10.1
Receiving Setup Data...................................................................................... 1014
19.10.2
Clearing the FIFO ........................................................................................... 1014
19.10.3
Overreading and Overwriting the Data Registers ........................................... 1014
19.10.4
Assigning Interrupt Sources to EP0 ................................................................ 1015
19.10.5
Clearing the FIFO When DMA Transfer is Enabled ...................................... 1015
19.10.6
Notes on TR Interrupt ..................................................................................... 1015
19.10.7
Restrictions on Peripheral Module Clock (P
φ) Operating Frequency............. 1016
19.10.8
Notes on Deep Software Standby Mode when USB is Used .......................... 1016
Section 20 I
2C Bus Interface 2 (IIC2)..............................................................1017
20.1
Features........................................................................................................................... 1017
20.2
Input/Output Pins............................................................................................................ 1019
20.3
Register Descriptions...................................................................................................... 1020
20.3.1
I
2C Bus Control Register A (ICCRA) ............................................................. 1021
20.3.2
I
2C Bus Control Register B (ICCRB) ............................................................. 1022
20.3.3
I
2C Bus Mode Register (ICMR)...................................................................... 1024
20.3.4
I
2C Bus Interrupt Enable Register (ICIER)..................................................... 1025
20.3.5
I
2C Bus Status Register (ICSR)....................................................................... 1028
20.3.6
Slave Address Register (SAR)........................................................................ 1031
20.3.7
I
2C Bus Transmit Data Register (ICDRT) ...................................................... 1032
20.3.8
I
2C Bus Receive Data Register (ICDRR)........................................................ 1032
20.3.9
I
2C Bus Shift Register (ICDRS)...................................................................... 1032
20.4
Operation ........................................................................................................................ 1033
20.4.1
I
2C Bus Format................................................................................................ 1033
20.4.2
Master Transmit Operation ............................................................................. 1034
20.4.3
Master Receive Operation .............................................................................. 1036
20.4.4
Slave Transmit Operation ............................................................................... 1038
20.4.5
Slave Receive Operation................................................................................. 1041
相關(guān)PDF資料
PDF描述
R5F61664RN50BGV 32-BIT, FLASH, RISC MICROCONTROLLER, PBGA176
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R5F64114DFB 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP100
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