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參數(shù)資料
| 型號： | PowerPC 405GP |
| 廠商： | IBM Microeletronics |
| 英文描述： | 32-bit RISC Embedded Controllers(32位RISC結(jié)構(gòu)嵌入式控制器) |
| 中文描述： | 32位RISC嵌入式控制器（32位的RISC結(jié)構(gòu)嵌入式控制器） |
| 文件頁數(shù)： | 57/58頁 |
| 文件大?。?/td> | 878K |
| 代理商： | POWERPC 405GP |
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PowerPC 405GP Embedded Processor Data Sheet
57
PCI Divider from PLB
D18/A20
C20/C19
Divide by 1
0
0
Divide by 2
0
1
Divide by 3
1
0
Divide by 4
1
1
External Bus Divider from PLB
K25/K20
K23/J21
Divide by 2
0
0
Divide by 3
0
1
Divide by 4
1
0
Divide by 5
1
1
ROM Width
AC2/N3
AD2/N7
8-bit ROM
0
0
16-bit ROM
0
1
32-bit ROM
1
0
Reserved
1
1
ROM Location
U2/P4
PPC405GP Peripheral Attach
0
PPC405GP PCI Attach
1
PCI Asynchronous Mode Enable
Y3/U4
Synchronous PCI Mode
0
Asynchronous Mode
1
PCI Arbiter Enable
AF18/AB18
Internal Arbiter Disabled
0
Internal Arbiter Enabled
1
Note:
The tune bits adjust parameters that control PLL jitter. The recommended values minimize jitter for the PLL implemented in the
PPC405GP. These bits are shown for information only; and do not require modification except in special clocking circumstances
such as spread spectrum clocking. For details on the use of Spread Spectrum Clock Generators (SSCGs) with the PPC405GP,
visit the technical documents area of the IBM PowerPC web site.
Strapping Pin Assignments (Continued)
Function
Option
Ball Strapping
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