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參數(shù)資料
| 型號： | PowerPC 405GP |
| 廠商： | IBM Microeletronics |
| 英文描述： | 32-bit RISC Embedded Controllers(32位RISC結構嵌入式控制器) |
| 中文描述： | 32位RISC嵌入式控制器（32位的RISC結構嵌入式控制器） |
| 文件頁數(shù)： | 52/58頁 |
| 文件大小： | 878K |
| 代理商： | POWERPC 405GP |
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PowerPC 405GP Embedded Processor Data Sheet
52
I/O Specifications—All
(Part 1 of 2)
Notes:
1.
PCI timings are for asynchronous operation up to 66MHz. PCI output hold time requirement is 1ns for 66MHz and 2ns
for 33MHz.
2. Ethernet interface meets timing requirements as defined by IEEE 802.3 standard.
Signal
Input (ns)
Output (ns)
Output Current (mA)
Clock
Notes
Setup Time
(minimum)
Hold Time
(minimum)
Valid Delay
(maximum)
50pF load
Hold Time
(minimum)
50pF load
I/O H
(maximum)
I/O L
(minimum)
PCI Interface
PCIAD31:0
PCIC3:0[BE3:0]
PCIClk
PCIDevSel
PCIFrame
PCIGnt0[Req]
PCIGnt1:5
PCIIDSel
PCIINT[PerWE]
PCIIRDY
PCIParity
PCIPErr
PCIReq0[Gnt]
PCIReq1:5
PCIReset
PCISErr
PCIStop
PCITRDY
Ethernet Interface
EMCMDClk
3
3
dc
3
3
0
0
dc
0
0
6
6
1.8
1.8
n/a
1.8
1.8
12.3
12.3
n/a
12.3
12.3
15.5
15.5
n/a
15.5
15.5
PCIClk
PCIClk
1
1
async
1
1
6
6
PCIClk
PCIClk
n/a
n/a
6
1.8
12.3
15.5
PCIClk
1
3
0
6
dc
6
6
6
1.8
dc
1.8
1.8
1.8
n/a
12.3
12.3
12.3
12.3
n/a
15.5
15.5
15.5
15.5
PCIClk
PCIClk
PCIClk
PCIClk
PCIClk
1
n/a
3
3
3
n/a
0
0
0
async
1
1
1
5
0
n/a
n/a
n/a
n/a
PCIClk
1
n/a
n/a
3
3
n/a
n/a
0
0
n/a
n/a
6
6
n/a
n/a
1.8
1.8
12.3
12.3
12.3
12.3
15.5
15.5
15.5
15.5
PCIClk
PCIClk
PCIClk
PCIClk
1
1
n/a
n/a
settable
1 OPB clock
period + 10ns
20
20
20
2
9
6
2, async
EMCMDIO[PHYMDIO]
100
0
1 OPB clock
period
2
2
2
9
6
EMCMDClk
2
EMCTxD3:0
EMCTxEn
EMCTxErr
PHYCol
PHYCrS
PHYRxClk
PHYRxD3:0
PHYRxDV
PHYRxErr
PHYTxClk
n/a
n/a
n/a
n/a
n/a
n/a
9
9
9
9
9
6
6
6
6
6
PHYTX
PHYTX
PHYTX
2
2
2
2, async
2, async
2, async
2
2
2
2, async
n/a
9
9
9
n/a
n/a
6
6
6
n/a
4
4
4
1
1
1
n/a
n/a
n/a
n/a
n/a
n/a
PHYRX
PHYRX
PHYRX
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