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參數(shù)資料
| 型號： | PIC18LF96J65-I/PT |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 51/131頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PIC MCU FLASH 48KX16 100TQFP |
| 標準包裝： | 90 |
| 系列： | PIC® 18F |
| 核心處理器： | PIC |
| 芯體尺寸： | 8-位 |
| 速度： | 41.667MHz |
| 連通性： | EBI/EMI，以太網(wǎng)，I²C，SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 70 |
| 程序存儲器容量： | 96KB（48K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 3808 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 16x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-TQFP |
| 包裝： | 托盤 |
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PIC18F97J60 FAMILY
DS39762F-page 26
2011 Microchip Technology Inc.
PORTB is a bidirectional I/O port. PORTB can be software
programmed for internal weak pull-ups on all inputs.
RB0/INT0/FLT0
RB0
INT0
FLT0
5
I/O
I
TTL
ST
Digital I/O.
External Interrupt 0.
Enhanced PWM Fault input (ECCP modules); enabled
in software.
RB1/INT1
RB1
INT1
6
I/O
I
TTL
ST
Digital I/O.
External Interrupt 1.
RB2/INT2
RB2
INT2
7
I/O
I
TTL
ST
Digital I/O.
External Interrupt 2.
RB3/INT3
RB3
INT3
8
I/O
I
TTL
ST
Digital I/O.
External Interrupt 3.
RB4/KBI0
RB4
KBI0
54
I/O
I
TTL
Digital I/O.
Interrupt-on-change pin.
RB5/KBI1
RB5
KBI1
53
I/O
I
TTL
Digital I/O.
Interrupt-on-change pin.
RB6/KBI2/PGC
RB6
KBI2
PGC
52
I/O
I
I/O
TTL
ST
Digital I/O.
Interrupt-on-change pin.
In-Circuit Debugger and ICSP programming clock pin.
RB7/KBI3/PGD
RB7
KBI3
PGD
47
I/O
I
I/O
TTL
ST
Digital I/O.
Interrupt-on-change pin.
In-Circuit Debugger and ICSP programming data pin.
TABLE 1-5:
PIC18F86J60/86J65/87J60 PINOUT I/O DESCRIPTIONS (CONTINUED)
Pin Name
Pin Number
Pin
Type
Buffer
Type
Description
TQFP
Legend:
TTL = TTL compatible input
CMOS
= CMOS compatible input or output
ST
= Schmitt Trigger input with CMOS levels
Analog
= Analog input
I
= Input
O
= Output
P
= Power
OD
= Open-Drain (no P diode to VDD)
Note 1:
Default assignment for ECCP2/P2A when CCP2MX Configuration bit is set.
2:
Default assignments for P1B/P1C/P3B/P3C (ECCPMX Configuration bit is set).
3:
Alternate assignment for ECCP2/P2A when CCP2MX Configuration bit is cleared.
4:
Alternate assignments for P1B/P1C/P3B/P3C (ECCPMX Configuration bit is cleared).
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