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參數(shù)資料
| 型號： | PIC18LF96J65-I/PT |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 127/131頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PIC MCU FLASH 48KX16 100TQFP |
| 標準包裝： | 90 |
| 系列： | PIC® 18F |
| 核心處理器： | PIC |
| 芯體尺寸： | 8-位 |
| 速度： | 41.667MHz |
| 連通性： | EBI/EMI，以太網(wǎng)，I²C，SPI，UART/USART |
| 外圍設備： | 欠壓檢測/復位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 70 |
| 程序存儲器容量： | 96KB（48K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 3808 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2 V ~ 3.6 V |
| 數(shù)據(jù)轉換器： | A/D 16x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-TQFP |
| 包裝： | 托盤 |
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2011 Microchip Technology Inc.
DS39762F-page 95
PIC18F97J60 FAMILY
ESTAT
—BUFER
—
r
—
RXBUSY
TXABRT
PHYRDY
-0-0 -000
EIE
—
PKTIE
DMAIE
LINKIE
TXIE
—
TXERIE
RXERIE
-000 0-00
EDMACSH
DMA Checksum Register High Byte
0000 0000
EDMACSL
DMA Checksum Register Low Byte
0000 0000
EDMADSTH
—
DMA Destination Register High Byte
---0 0000
EDMADSTL
DMA Destination Register Low Byte
0000 0000
EDMANDH
—
DMA End Register High Byte
---0 0000
EDMANDL
DMA End Register Low Byte
0000 0000
EDMASTH
—
DMA Start Register High Byte
---0 0000
EDMASTL
DMA Start Register Low Byte
0000 0000
ERXWRPTH
—
Receive Buffer Write Pointer High Byte
---0 0000
ERXWRPTL Receive Buffer Write Pointer Low Byte
0000 0000
ERXRDPTH
—
Receive Buffer Read Pointer High Byte
---0 0101
ERXRDPTL
Receive Buffer Read Pointer Low Byte
1111 1010
ERXNDH
—
Receive End Register High Byte
---1 1111
ERXNDL
Receive End Register Low Byte
1111 1111
ERXSTH
—
Receive Start Register High Byte
---0 0101
ERXSTL
Receive Start Register Low Byte
1111 1010
ETXNDH
—
Transmit End Register High Byte
---0 0000
ETXNDL
Transmit End Register Low Byte
0000 0000
ETXSTH
—
Transmit Start Register High Byte
---0 0000
ETXSTL
Transmit Start Register Low Byte
0000 0000
EWRPTH
—
Buffer Write Pointer High Byte
---0 0000
EWRPTL
Buffer Write Pointer Low Byte
0000 0000
EPKTCNT
Ethernet Packet Count Register
0000 0000
ERXFCON
UCEN
ANDOR
CRCEN
PMEN
MPEN
HTEN
MCEN
BCEN
1010 0001
EPMOH
—
Pattern Match Offset Register High Byte
---0 0000
EPMOL
Pattern Match Offset Register Low Byte
0000 0000
EPMCSH
Pattern Match Checksum Register High Byte
0000 0000
EPMCSL
Pattern Match Checksum Register Low Byte
0000 0000
EPMM7
Pattern Match Mask Register Byte 7
0000 0000
EPMM6
Pattern Match Mask Register Byte 6
0000 0000
EPMM5
Pattern Match Mask Register Byte 5
0000 0000
EPMM4
Pattern Match Mask Register Byte 4
0000 0000
EPMM3
Pattern Match Mask Register Byte 3
0000 0000
EPMM2
Pattern Match Mask Register Byte 2
0000 0000
EPMM1
Pattern Match Mask Register Byte 1
0000 0000
EPMM0
Pattern Match Mask Register Byte 0
0000 0000
TABLE 6-5:
REGISTER FILE SUMMARY (PIC18F97J60 FAMILY) (CONTINUED)
File Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Values on
POR, BOR
Details on
Page:
Legend: x
= unknown; u = unchanged; - = unimplemented, read as ‘0’; q = value depends on condition; r = reserved bit, do not modify. Shaded cells
are unimplemented, read as ‘0’.
Note 1:
Bit 7 and bit 6 are cleared by user software or by a POR.
2:
Bit 21 of the PC is only available in Serial Programming modes.
3:
Reset value is ‘0’ when Two-Speed Start-up is enabled and ‘1’ if disabled.
4:
Alternate names and definitions for these bits when the MSSP module is operating in I2C Slave mode.
5:
These bits and/or registers are only available in 100-pin devices; otherwise, they are unimplemented and read as ‘0’. Reset values shown
apply only to 100-pin devices.
6:
These bits and/or registers are only available in 80-pin and 100-pin devices. In 64-pin devices, they are unimplemented and read as ‘0’. Reset
values are shown for 100-pin devices.
7:
In Microcontroller mode, the bits in this register are unwritable and read as ‘0’.
8:
PLLEN is only available when either ECPLL or HSPLL Oscillator mode is selected; otherwise, read as ‘0’.
9:
Implemented in 100-pin devices in Microcontroller mode only.
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