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參數(shù)資料
| 型號(hào)： | PEF2015 |
| 廠商： | SIEMENS A G |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Mini IOM-2 Controller MICO |
| 中文描述： | SPECIALTY TELECOM CIRCUIT, PDSO28 |
| 文件頁數(shù)： | 79/84頁 |
| 文件大小： | 1568K |
| 代理商： | PEF2015 |
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PEF 2015
Electrical Characteristics
Semiconductor Group
79
12.97
PCM and Configurable Interface Timing
Parameter
Symbol
Limit Values Unit Test Conditions
min.
max.
240
ns
80
ns
Clock period
Clock period low
t
CP
t
CPL
t
CPH
t
CP
t
CPL
t
CPH
t
FS
t
FH
t
DCD
t
S
t
H
t
S
t
H
t
S
t
H
t
S
t
H
t
D
t
T
t
CDF
t
CDR
clock frequency
≤
4096 kHz
Clock period high
Clock period
Clock period low
Clock period high
Frame set-up time to clock
Frame hold time from clock
Data clock delay
Serial data input set-up time
Serial data hold time
Serial data input set-up time
Serial data hold time
Serial data input set-up time
Serial data hold time
Serial data input set-up time
Serial data hold time
PCM-serial data output delay
Tristate control delay
CFI-serial data output delay
CFI-serial data output delay
100
120
50
50
25
50
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
clock frequency
> 4096 kHz
125
7
35
15
55
20
50
0
75
PCM-input data
frequency > 4096 kbit/s
PCM-input data
frequency
≤
4096 kbit/s
CFI-input data
frequency > 4096 kbit/s
CFI-input data
frequency
≤
4096 kbit/s
55
60
65
90
falling clock edge
rising clock edge
–
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PEF2023 | ISDN DC Converter Circuit IDCC |
| PEB2023 | ISDN DC Converter Circuit IDCC |
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| PEB20321 | Multichannel Network Interface Controller for HDLC |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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