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PEF 2015
Semiconductor Group
3
12.97
1
1.1
1.2
Overview
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .6
Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .7
Pinning Diagram
(top view) 8
Pin Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .9
Logic Symbol . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .12
Functional Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .13
1.3
1.4
1.5
2
2.1
2.2
2.3
2.4
2.5
2.6
Functional Description
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .14
Configurable Interface CFI . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .14
Serial PCM Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .14
Microprocessor Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .15
Memory Structure and Switching . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .15
Pre-processed Channels, Layer-1 Support . . . . . . . . . . . . . . . . . . . . . . . .17
Special Functions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .17
3
3.1
3.2
3.3
3.4
3.4.1
3.4.2
3.4.3
3.4.4
3.5
3.5.1
3.5.2
3.5.2.1
3.5.2.2
3.5.2.3
3.5.2.4
3.5.3
Operational Description
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .18
Microprocessor Interface Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . .18
Clocking . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .19
Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .19
MICO Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .20
PCM-Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .20
Configurable Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .23
Switching Functions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .24
Special Functions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .28
Initialization Procedure . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29
Hardware Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29
MICO Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29
Register Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29
Control Memory Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29
Initialization of Pre-processed Channels . . . . . . . . . . . . . . . . . . . . .30
Initialization of the Upstream Data Memory (DM) Tristate Field . . . .31
Activation of the PCM- and CFI-Interfaces . . . . . . . . . . . . . . . . . . . . . .32
4
4.1
4.2
4.2.1
4.2.1.1
4.2.1.2
4.2.1.3
4.2.1.4
4.2.1.5
4.2.1.6
Registers Summary
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .33
Register Address Arrangement . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .33
Detailed Register Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .35
PCM-Interface Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .35
PCM-Mode Register (PMOD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .35
Bit Number per PCM-Frame (PBNR) . . . . . . . . . . . . . . . . . . . . . . . .36
PCM-Offset Downstream Register (POFD) . . . . . . . . . . . . . . . . . . .36
PCM-Offset Upstream Register (POFU) . . . . . . . . . . . . . . . . . . . . .37
PCM-Clock Shift Register (PCSR) . . . . . . . . . . . . . . . . . . . . . . . . . .38
PCM-Input Comparison Mismatch Register (PICM) . . . . . . . . . . . . .38