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參數(shù)資料
| 型號(hào)： | PEF2015 |
| 廠商： | SIEMENS A G |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Mini IOM-2 Controller MICO |
| 中文描述： | SPECIALTY TELECOM CIRCUIT, PDSO28 |
| 文件頁數(shù)： | 66/84頁 |
| 文件大小： | 1568K |
| 代理商： | PEF2015 |
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PEF 2015
Registers Summary
Semiconductor Group
66
12.97
SOV
Synchronous Transfer Overflow; The SOV-interrupt is generated if the
μ
P
fails to access the data registers (STDA, STDB) within the access window.
The SOV-bit is reset by reading ISTA.
4.2.6.6
Access in demultiplexed
μ
P-interface mode:
Mask Register MICO (MASK)
write
address: E
H
OMDR:RBS = 0
Access in multiplexed
μ
P-interface mode:
Reset value: 00
H
write
address: 1C
H
A logical 1 disables the corresponding interrupt as described in the ISTA-register.
A masked interrupt is stored internally and reported in ISTA immediately if the mask is
released. However, an SFI-interrupt is also reported in ISTA if masked. In this case no
interrupt is generated. When writing register MASK while ISTA indicates a non masked
interrupt, INT is temporarily set into the inactive state.
bit 7
bit 0
TIN
SFI
MFFI
MAC
PFI
1
SIN
SOV
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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