參數(shù)資料
型號： OR3T125-4PS208I
英文描述： 1.8V LOW COST OP AMP, -40C to +85C, 5-SOT-23, T/R
中文描述： 現(xiàn)場可編程門陣列（FPGA）
文件頁數(shù)： 128/210頁
文件大小： 4663K
代理商： OR3T125-4PS208I
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128
Lucent Technologies Inc.
Data Sheet
June 1999
ORCA Series 3C and 3T FPGAs
Timing Characteristics
(continued)
Table 57. OR3C/Txxx Input to ExpressCLK (ECLK) Fast-Capture Setup/Hold Time (Pin-to-Pin)
OR3Cxx Commercial: V
DD
= 5.0 V ± 5%, 0 °C
<
T
A
<
70 °C; Industrial: V
DD
= 5.0 V ± 10%, –40 °C
<
T
A
<
+85 °C.
OR3Txxx Commercial: V
DD
= 3.0 V to 3.6 V, 0 °C
<
T
A
<
70 °C; Industrial: V
DD
= 3.0 V to 3.6 V, –40 °C
<
T
A
<
+85 °C.
Note:
The pin-to-pin timing parameters in this table should be used instead of results reported by ORCAFoundry.
The ECLK delays are to all of the PIOs on one side of the device for middle pin input, or two sides of the device for corner pin input. The delay
includes both the input buffer delay and the clock routing to the PIO clock input.
Description
(T
J
= 85 °C, V
DD
= min)
Device
Speed
Unit
-4
-5
-6
-7
Min
—
—
1.36
1.25
—
—
—
6.91
6.79
—
—
—
0.00
0.00
—
—
—
4.94
4.82
—
—
—
0.00
0.00
—
—
—
0.00
0.00
—
Max
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
Min
1.34
1.30
1.22
1.14
1.03
6.30
6.27
6.19
6.11
6.00
0.00
0.00
0.00
0.00
0.00
4.39
4.35
4.28
4.21
4.10
0.00
0.00
0.00
0.00
0.00
0.00
0.00
0.00
0.00
0.00
Max
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
Min
0.88
0.86
0.83
0.80
0.76
5.32
5.30
5.27
5.24
5.20
0.00
0.00
0.00
0.00
0.00
3.51
3.40
3.18
2.98
2.63
0.00
0.00
0.00
0.00
0.00
0.00
0.00
0.00
0.00
0.00
Max
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
Min
0.83
0.82
0.80
0.77
0.74
5.98
5.97
5.95
5.93
5.90
0.00
0.00
0.00
0.00
0.00
4.41
4.31
4.11
3.91
3.61
0.00
0.00
0.00
0.00
0.00
0.00
0.00
0.00
0.00
0.00
Max
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
Input to ECLK Setup Time (middle
ECLK pin)
OR3T20
OR3T30
OR3C/T55
OR3C/T80
OR3T125
OR3T20
OR3T30
OR3C/T55
OR3C/T80
OR3T125
OR3T20
OR3T30
OR3C/T55
OR3C/T80
OR3T125
OR3T20
OR3T30
OR3C/T55
OR3C/T80
OR3T125
OR3T20
OR3T30
OR3C/T55
OR3C/T80
OR3T125
OR3T20
OR3T30
OR3C/T55
OR3C/T80
OR3T125
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Input to ECLK Setup Time (middle
ECLK pin, delayed data input)
Input to ECLK Setup Time (corner
ECLK pin)
Input to ECLK Setup Time (corner
ECLK pin, delayed data input)
Input to ECLK Hold Time (middle
ECLK pin)
Input to ECLK Hold Time (middle
ECLK pin, delayed data input)
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PDF描述
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OR3T125-5BC432I Field Programmable Gate Array (FPGA)
OR3T125-5BC600I Dual 1.8V, 1MHz OP, -40C to +125C, 8-PDIP, TUBE
OR3T125-5PS208I Dual 1.8V, 1MHz OP, I temp, -40C to +85C, 8-MSOP, TUBE
OR3T125-5PS240I Dual 1.8V, 1MHz OP, I temp, -40C to +85C, 8-PDIP, TUBE
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