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參數(shù)資料
| 型號(hào)： | MX98905BFC |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | The MX98905 is designed for easy implementation of CSMA/CD local area networks, |
| 中文描述： | 該MX98905是專(zhuān)為易于實(shí)現(xiàn)的多址/光盤(pán)局域網(wǎng)， |
| 文件頁(yè)數(shù)： | 77/86頁(yè) |
| 文件大?。?/td> | 352K |
| 代理商： | MX98905BFC |
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77
P/N: PM0365
REV. 1.3, NOV 20 ,1995
MX98905B
AC CHARACTRISTICS
SYMBOL
PARAMETER
MIN. MAX.
UNIT
T1
MEMA1-15 valid before RSCXL Asserted (Note1)
30
ns
T2
MEMA1-15 Valid before MSRD/MSWR asserted
20
ns
T3
MSRDL-WRL Width
2
bcyc
T4
MEMA1-15 Valid to MSRDL or MSWRL Deasserted
40
ns
T5
MEMA1-15 Valid after MSRDL-WRL
10
ns
Deasserted
T6
RCSXL Held after MSRDL-WRL Deasserted
200 400
ns
(Note1)
T7
RCXL and MEMA1-15 valid to MEMD0-15 valid
100
ns
T8
Read Data Hold from MSRDL Deasserted
0
ns
T9
Write Data Set-Up to MSWRL Deasserted
60
ns
T10
Write Data Held from MSWRL Deasserted
10
ns
T11
Time Between Transfers
4
bcyc
T12
Minimum bus Clock High Time (bch)
10
ns
T13
Minimum Bus Clock Low Time (bcl)
20
ns
T14
Minimum Bus Clock Cycle Time (bcyc)
50
ns
Note 1 :
In 8-bit mode RCSXL refers to RCS1L only. In 16-bit mode RCSXL refers to both RCS1L and RCS2L.
MEMORY SUPPORT BUS ACCESSES (FOR I/O PORT OR FIFO TRANSFERS)
BSCK
MEMA1-15
RCSXL
MSRDL
or
MSWRL
T12
T13
T14
T1
T11
T4
T5
T6
T2
T3
T7
T8
T9
T10
t1
t2
t3
t4
t1
MEMD0-15
(READ)
MEMD0-15
(WRITE)
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