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參數(shù)資料
| 型號： | ML87V3116 |
| 廠商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分類： | 顯示控制器 |
| 英文描述： | DOT MAT LCD DSPL CTLR, PQFP176 |
| 封裝： | 24 X 24 MM, 0.50 MM PITCH, PLASTIC, LQFP-176 |
| 文件頁數(shù)： | 4/46頁 |
| 文件大?。?/td> | 273K |
| 代理商： | ML87V3116 |
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PEDL87V3116-02
OKI Semiconductor
ML87V3116
12/47
2.2 Display Interface
2.2.1 Display Output Format
The TFT-LCD mode or TV mode can be selected as a display output format.
TFT-LCD mode
: Progressive scan, output synchronization, variable number of pixels
TV mode
: Interlace scan, fixed to 525i or 625i
[Control Registers]
DOFMT
: Display format, 1 bit (write/read)
“0”: TFT-LCD mode
“1”: TV mode
TVSTD
: TV format selection, 3 bits (write/read)
“000” : 525i, 27.0 MHz (NTSC equivalent, BT.656)
“001” : 525i, 13.5 MHz (NTSC equivalent, BT.601)
“010” : 525i, 12.272727 MHz (NTSC equivalent, square pixels)
“011” : 525i, 14.31818 MHz (NTSC equivalent, 4fsc)
“100” : 625i, 27.0 MHz (PAL equivalent, BT.656)
“101” : 625i, 13.5 MHz (PAL equivalent, BT.601)
“110” : 625i, 14.75 MHz (PAL equivalent, square pixels)
Note: It is necessary to set the system clock to each frequency described above.
2.2.2 Output Synchronous Signals
The functions of the output synchronous signals partially vary with the display output format.
Function
Remarks
Sync.
signal
TFT-LCD mode
TV mode
CP
Data clock
LDP1
Line drive pulse 1
HSYNC (horizontal
synchronous signal)
LDP2
Line drive pulse 2
(Not used)
LDP3
Line drive pulse 3
(Not used)
LDP4
Line drive pulse 4
(Not used)
HST1
Horizontal start signal 1
(Not used)
Pulse width: 1 CP
HST2
Horizontal start signal 2
(Not used)
Pulse width: 1 CP
FDP1
Frame drive pulse 1
VSYNC (vertical
synchronous signal)
FDP2
Frame drive pulse 2
(Not used)
Possible to AND with
LDP4
FDP3
Frame drive pulse 3
(Not used)
Possible to OR with
LDP2
FIDF
Current-alternating signal
Field ID signal
DISP
Display enable
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