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參數(shù)資料
| 型號： | ML87V3116 |
| 廠商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分類： | 顯示控制器 |
| 英文描述： | DOT MAT LCD DSPL CTLR, PQFP176 |
| 封裝： | 24 X 24 MM, 0.50 MM PITCH, PLASTIC, LQFP-176 |
| 文件頁數(shù)： | 22/46頁 |
| 文件大小： | 273K |
| 代理商： | ML87V3116 |
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PEDL87V3116-02
OKI Semiconductor
ML87V3116
29/47
2.6.2 Bus Control Signals
The assignment of the bus control signals to the input/output pins is determined by the host interface bus mode.
Table-F5.5.1 Bus Control Signals
Bus type
Pin name
A0
A1
A2
A4
A5
B0
B1
A18-16
AD15-00
A15-00
AD15-00
D07-00
—
REGS
CSN
REN
RWN
REN
WEN
—
WELN
BSN
—
BS
BSN
ASN
AS
DSN
—
WEHN
BSYN
ACK
BSYN
BCLK
REGS
: Memory/register address space selection: “L”: Memory, “H”: Register
CSN
: Chip select (active “L”)
REN
: Read enable (active “L”)
WEN
: Write enable (active “L”)
WEHN
: Upper byte write enable (active “L”)
WELN
: Lower byte write enable (active “L”)
RWN
: Read/write selection: “L”: Write, “H”: Read
BSN
: Bus start (active “L”)
ASN
: Address strobe (active “L”)
DSN
: Data strobe (active “L”)
BSYN
: Bus busy or wait, variable width according to wait time (active “L”)
ACK
: Data acknowledge, 1 clock width (active “L”)
BCLK
: Bus clock
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PDF描述 |
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