參數(shù)資料
型號: MCF53016CMJ240J
廠商: Freescale Semiconductor
文件頁數(shù): 35/62頁
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描述: IC MCU 32BIT 128KB 256MAPBGA
標準包裝: 450
系列: MCF5301x
核心處理器: Coldfire V3
芯體尺寸: 32-位
速度: 240MHz
連通性: EBI/EMI,以太網(wǎng),I²C,MMC,SPI,SSI,UART/USART,USB,USB OTG
外圍設(shè)備: DMA,PWM,WDT
輸入/輸出數(shù): 83
程序存儲器容量: 16KB(16K x 8)
程序存儲器類型: 緩存
RAM 容量: 128K x 8
電壓 - 電源 (Vcc/Vdd): 1.08 V ~ 3.6 V
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 256-LBGA
包裝: 托盤
MCF5301x Data Sheet, Rev. 5
Preliminary—Subject to Change Without Notice
Preliminary Electrical Characteristics
Freescale Semiconductor
40
Figure 27. DSPI Classic SPI Timing — Master Mode
DS10
DSPI_SCK to DSPI_SOUT invalid
0
ns
DS11
DSPI_SIN to DSPI_SCK input setup
2
ns
DS12
DSPI_SCK to DSPI_SIN input hold
7
ns
DS13
DSPI_SS active to DSPI_SOUT driven
20
ns
DS14
DSPI_SS inactive to DSPI_SOUT not driven
18
ns
1 Timings shown are for DMCR[MTFE] = 0 (classic SPI) and DCTARn[CPHA] = 0. Data is sampled on the DSPI_SIN pin
on the odd-numbered DSPI_SCK edges and driven on the DSPI_SOUT pin on even-numbered DSPI edges.
2 When in master mode, the baud rate is programmable in DCTARn[DBR], DCTARn[PBR], and DCTARn[BR].
3 This specification assumes a 50/50 duty cycle setting. The duty cycle is programmable in DCTARn[DBR],
DCTARn[CPHA], and DCTARn[PBR].
4 The DSPI_PCSn to DSPI_SCK delay is programmable in DCTARn[PCSSCK] and DCTARn[CSSCK].
5 The DSPI_SCK to DSPI_PCSn delay is programmable in DCTARn[PASC] and DCTARn[ASC].
Table 26. DSPI Module AC Timing Specifications1 (continued)
Name
Characteristic
Symbol
Min
Max
Unit
Notes
DSPI_PCSn
DSPI_SCK
DSPI_SOUT
DSPI_SIN
DSPI_SCK
(DCTARn[CPOL] = 1)
(DCTARn[CPOL] = 0)
Data
Last Data
First Data
Data
Last Data
DS1
DS2
DS3
DS4
DS5
DS6
DS7
DS8
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PDF描述
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