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參數(shù)資料
| 型號： | MC68341FT16V |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16.78 MHz, MICROPROCESSOR, PQFP160 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 206/514頁 |
| 文件大?。?/td> | 2891K |
| 代理商： | MC68341FT16V |
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6- 20
MC68341 USER'S MANUAL
MOTOROLA
same size, two cycles will transfer the complete operand. If the source and destination
operands are different sizes, the number of cycles will vary. If the source is a long-word and
the destination is a byte, there would be one bus cycle for the read and four bus cycles for
the write. Once the DMA channel has started a dual-address operand transfer, it must
complete that transfer before releasing ownership of the bus or servicing a request for
another channel of equal or higher priority, unless one of the bus cycles is terminated with
a bus error during the transfer.
6.6.3 Channel Termination
The channel can terminate by normal completion or as the result of an error. The status of
a DMA operation can be determined by reading the CSR. The DMA channel can also
interrupt the processor to inform it of errors, normal transfer completion, or breakpoints.
The fast termination option can also be used to provide a two-clock access for external
requests.
6.6.3.1 CHANNEL TERMINATION. The channel operation can be terminated for several
reasons: the BTC is decremented to zero, a peripheral device asserts DONE≈ during an
operand transfer, the STR bit is cleared in the CCR, a bus cycle is terminated with a bus
error, or a reset occurs.
6.6.3.2 INTERRUPT OPERATION. Interrupts can be generated by error termination of a
bus cycle or by normal channel completion. Specifically, if the CCR interrupt error (INTE)
bit is set and a bus error on source (CCR BES) bit, bus error on destination (CCR BED) bit,
or configuration error (CCR CONF) bit is set, the CCR IRQ bit is set. In this case, clearing
the INTE, BES, BED, or CONF bits causes the IRQ bit to be cleared. If the interrupt normal
(CCR INTN) bit is set and the CCR DONE bit is set, the IRQ bit is set. In this case, clearing
the INTN or the DONE bit causes the IRQ bit to be cleared. If the interrupt breakpoint (CCR
INTB) and the CSR BRKP bits are set, the IRQ bit is set. Clearing INTB or BRKP clears
IRQ.
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Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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相關PDF資料 |
PDF描述 |
|---|---|
| MC68360RC25VC | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CPGA241 |
| MC68EN360FE25C | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| MC68EN360ZP25C | 32-BIT, 25 MHz, RISC MICROCONTROLLER, PBGA357 |
| MC68EN360CRC25C | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CPGA241 |
| MC68360RC25C | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CPGA241 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68341FT25 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Users Manual |
| MC68341UMAD | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Users Manual |
| MC68349 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HIGH PERFORMANCE INTEGRATED PROCESSOR |
| MC68349FT25A | 制造商:Motorola Inc 功能描述: |
| MC68349V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HIGH PERFORMANCE INTEGRATED PROCESSOR |
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