參數(shù)資料
型號(hào)： MC68341FT16V
廠(chǎng)商： FREESCALE SEMICONDUCTOR INC
元件分類(lèi)： 微控制器/微處理器
英文描述： 16.78 MHz, MICROPROCESSOR, PQFP160
封裝： PLASTIC, QFP-160
文件頁(yè)數(shù)： 177/514頁(yè)
文件大?。?/td> 2891K
代理商： MC68341FT16V
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5- 102
MC68341 USER’S MANUAL
MOTOROLA
Instruction
Head
Tail
Cycles
TBLUN
Dn:Dm, Dp
30
0
34-40(0/2/0)
TBLUN (Save)*
CEA, Dn
1
3(0/1/0)
TBLUN (Op)
CEA, Dn
6
0
39-45(2X/1/0)
X
= There is one bus cycle for byte and word operands and two bus cycles for long
operands. For long bus cycles, add two clocks to the tail and to the number of
cycles.
<= Maximum time (certain data or mode combinations may execute faster).
su
= The execution time is identical for signed or unsigned operands.
*These instructions have an additional save operation that other instructions do not have. To
calculate total instruction time, calculate save,
ea, and operation execution times, then
combine in the order listed, using equations in 5.7.1.6 Instruction Execution Time
Calculations. A save operation is not run for long-word divide and multiply instructions
when
FEA = Dn,
5.7.3.6
IMMEDIATE
ARITHMETIC/LOGIC
INSTRUCTIONS.
The immediate
arithmetic/logic instruction table indicates the number of clock periods needed for the
processor to fetch the source immediate data value and to perform the specified
arithmetic/logic instruction using the specified addressing mode. Footnotes indicate when
to account for the appropriate fetch effective or fetch immediate EA times. The total
number of clock cycles is outside the parentheses. The numbers inside parentheses
(r/p/w) are included in the total clock cycle number. All timing data assumes two-clock
reads and writes.
Instruction
Head
Tail
Cycles
MOVEQ
#, Dn
0
2(0/1/0)
ADDQ
#, Rn
0
2(0/1/0)
ADDQ
#,
FEA
0
3
5(0/1/x)
SUBQ
#, Rn
0
2(0/1/0)
SUBQ
#,
FEA
0
3
5(0/1/x)
ADDI
#, Rn
0
2(0/1/0)
ADDI
#,
FEA
0
3
5(0/1/x)
ANDI
#, Rn
0
2(0/1/0)
ANDI
#,
FEA
0
3
5(0/1/x)
EORI
#, Rn
0
2(0/1/0)
EORI
#,
FEA
0
3
5(0/1/x)
ORI
#, Rn
0
2(0/1/0)
ORI
#,
FEA
0
3
5(0/1/x)
SUBI
#, Rn
0
2(0/1/0)
SUBI
#,
FEA
0
3
5(0/1/x)
CMPI
#, Rn
0
2(0/1/0)
CMPI
#,
FEA
0
3
5(0/1/x)
X =
There is one bus cycle for byte and word operands and two bus cycles for long-
word operands. For long-word bus cycles, add two clocks to the tail and to the
number of cycles.
= An # fetch EA time must be added for this instruction: FEA +FEA + OPER
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述
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