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參數(shù)資料
| 型號(hào)： | MB8118160A-70 |
| 廠商： | Fujitsu Limited |
| 英文描述： | CMOS 1M×16 BIT Fast Page Mode Dynamic RAM(CMOS 1M×16 位快速頁面存取模式動(dòng)態(tài)RAM) |
| 中文描述： | 的CMOS 100萬× 16位快速頁面模式動(dòng)態(tài)RAM的CMOS（100萬× 16位快速頁面存取模式動(dòng)態(tài)內(nèi)存） |
| 文件頁數(shù)： | 21/26頁 |
| 文件大小： | 494K |
| 代理商： | MB8118160A-70 |
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21
MB8118160A-60/MB8118160A-70
t
ON
Fig. 15 – HIDDEN REFRESH CYCLE
“H” or “L”
ROW
ADDRESS
DESCRIPTION
A hidden refresh cycle may be performed while maintaining the latest valid data at the output by extending the active time of LCAS
or UCAS and cycling RAS. The refresh row address is provided by the on-chip refresh address counter. This eliminates the need for
the external row address that is required by DRAMs that do not have CAS-before-RAS refresh capability.
HIGH-Z
t
RC
t
RAS
COLUMN
ADDRESS
t
RAS
t
RC
t
RP
t
OEL
t
RCD
t
RAD
t
RSH
t
CHR
t
RP
t
CRP
t
RAH
t
ASR
t
ASC
t
AR
t
RAL
t
CAH
t
RCS
t
RRH
t
AA
t
RAC
t
CAC
t
DZC
t
CDD
t
OFF
t
OH
VALID DATA OUT
HIGH-Z
t
DZO
t
OEA
t
OEZ
t
OED
RAS
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
LCAS
or
UCAS
WE
DQ
(Input)
A
0
to A
9
V
OH
V
OL
DQ
(Output)
V
IH
V
IL
OE
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PDF描述 |
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