- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄369889 > M68HC000 (Motorola, Inc.) 16-/32-Bit Microprocessor(16/32位微處理器) PDF資料下載
參數(shù)資料
| 型號： | M68HC000 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 16-/32-Bit Microprocessor(16/32位微處理器) |
| 中文描述： | 16/32位微處理器（16/32位微處理器） |
| 文件頁數(shù)： | 77/184頁 |
| 文件大小： | 1006K |
| 代理商： | M68HC000 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁當(dāng)前第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁
MOTOROLA
M68000 8-/16-/32-BIT MICROPROCESSORS USER'S MANUAL
5-31
Table 5-1.
DTACK
,
BERR
, and
HALT
Assertion Results
Case
No.
Control
Signal
Asserted on
Rising Edge
of State
MC68000/MC68HC000/001
EC000/MC68008 Results
MC68010 Results
N
N+2
1
DTACK
BERR
HALT
A
NA
NA
S
NA
X
Normal cycle terminate and continue.
Normal cycle terminate and continue.
2
DTACK
BERR
HALT
A
NA
A/S
S
NA
S
Normal cycle terminate and halt.
Continue when
HALT
negated.
Normal cycle terminate and halt.
Continue when
HALT
negated.
3
DTACK
BERR
HALT
X
A
NA
X
S
NA
Terminate and take bus error trap.
Terminate and take bus error trap.
4
DTACK
BERR
HALT
A
NA
NA
S
A
NA
Normal cycle terminate and continue.
Terminate and take bus error trap.
5
DTACK
BERR
HALT
X
A
A/S
X
S
S
Terminate and retry when
HALT
removed.
Terminate and retry when
HALT
removed.
6
DTACK
BERR
HALT
A
NA
NA
S
A
A
Normal cycle terminate and continue.
Terminate and retry when
HALT
removed.
LEGEND:
N — The number of the current even bus state (e.g., S4, S6, etc.)
A — Signal asserted in this bus state
NA
— Signal not asserted in this bus state
X — Don't care
S — Signal asserted in preceding bus state and remains asserted in this state
NOTE: All operations are subject to relevant setup and hold times.
The negation of
BERR
and
HALT
under several conditions is shown in Table 5-6. (
DTACK
is assumed to be negated normally in all cases; for reliable operation, both
DTACK
and
BERR
should be negated when address strobe is negated).
EXAMPLE A:
A system uses a watchdog timer to terminate accesses to unused address space. The
timer asserts
BERR
after timeout (case 3).
EXAMPLE B:
A system uses error detection on random-access memory (RAM) contents. The system
designer may:
DTACK
until the data is verified. If data is invalid, return
BERR
and
HALT
simultaneously to retry the error cycle (case 5).
2. Delay
DTACK
until the data is verified. If data is invalid, return
BERR
at the same
time as
DTACK
(case 3).
3. For an MC68010, return
DTACK
before data verification. If data is invalid, assert
BERR
and
HALT
to retry the error cycle (case 6).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M68HC001 | 16-/32-Bit Microprocessor(16/32位微處理器) |
| M68EC000 | 16/32 Bit Microprocesso(16/32位微處理器) |
| M68HC16 | 16-Bit Microcontroller(16位微控制器) |
| MAC08BT1 | TRIAC 0.8 AMPERE RMS 200 thru 600 Volts |
| MAC08MT1 | SENSITIVE GATE TRIACS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M68HC05 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| M68HC05_13 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:M68HC05 Microcontrollers |
| M68HC05EVS | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Motorola M68HC05 Family Evaluation System |
| M68HC05M68H | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit |
| M68HC08 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。