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參數(shù)資料
| 型號： | IDT82V2052EPFG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 46/70頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU E1 2CH SHORT HAUL 80-TQFP |
| 標準包裝： | 45 |
| 類型： | 線路接口裝置（LIU） |
| 規(guī)程： | E1 |
| 電源電壓： | 3.13 V ~ 3.47 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 80-LQFP |
| 供應(yīng)商設(shè)備封裝： | 80-TQFP（14x14） |
| 包裝： | 托盤 |
| 其它名稱： | 82V2052EPFG |
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IDT82V2052E
DUAL CHANNEL E1 SHORT HAUL LINE INTERFACE UNIT
HARDWARE CONTROL PIN SUMMARY
50
December 12, 2005
5
HARDWARE CONTROL PIN SUMMARY
Table-41 Hardware Control Pin Summary
Pin No.
TQFP
Symbol
Description
9
10
MODE1
MODE0
MODE[1:0]: Operation mode of Control interface select (global control)
00= Hardware interface
01= Serial interface
10= Parallel - non-Multiplexed - Motorola Interface
11= Parallel - non-Multiplexed - Intel Interface
13
12
TERM1
TERM2
TERMn: Termination interface select (per channel control)
These pins select internal or external impedance matching for channel n (n=1 or 2)
0 = ternary interface with internal impedance matching network.
1 = ternary interface with external impedance matching network
14
15
RXTXM1
RXTXM0
RXTXM[1:0]: Receive and transmit path operation mode select (global control)
00= single rail with HDB3 coding
01= single rail with AMI coding
10= dual rail interface with CDR enable
11= slicer mode
51
47
PULS1
PULS2
PULSn: These pins are used to select the following functions (per channel control):
Transmit pulse template
Internal termination impedance (75
/ 120 )
PULSn
TCLK
Cable impedance (internal
matching impedance)
Cable loss
0
2.048 MHz
75
0-24 dB
1
2.048 MHz
120
0-24 dB
57
59
RPD1
RPD2
RPDn: Receiver power down control (per channel control)
0= Normal operation
1= receiver power down
46
45
56
55
PATT11
PATT10
PATT21
PATT20
PATTn[1:0]: Transmit test pattern select (per channel control)
In hardware control mode, these pins select the transmit pattern for channel n (n=1 or 2)
00 = normal
01= All Ones
10= PRBS
11= transmitter power down
16
17
JA1
JA0
JA[1:0]: Jitter attenuation position, bandwidth and the depth of FIFO select (global control)
00= JA is disabled
01= JA in receiver, broad bandwidth, FIFO=64 bits
10= JA in receiver, narrow bandwidth, FIFO=128 bits
11= JA in transmitter, narrow bandwidth, FIFO=128 bits
19
18
MONT1
MONT2
MONTn: Receive Monitor n gain select (per channel control)
In hardware control mode with ternary interface, this pin selects the receive monitor gain for receiver n (n=1 or 2)
0= 0 dB
1= 26 dB
42
41
44
43
LP11
LP10
LP21
LP20
LPn[1:0]: Loopback mode select (per channel control)
When the chip is configured by hardware, these pins are used to select loopback operation modes for channel n.
00= no loopback
01= analog loopback
10= digital loopback
11= remote loopback
20
THZ
THZ: Transmitter Driver High Impedance Enable (global control)
This signal enables or disables both of the transmitter drivers. A low level on this pin enables both of the two drivers while a high
level on this pin places both of the two drivers in high impedance state.
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PDF描述 |
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