參數(shù)資料
型號: IDT707288L20PF8
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: SRAM
英文描述: 64K X 16 DUAL-PORT SRAM, 20 ns, PQFP100
封裝: 14 X 14 MM, 1.40 MM, TQFP-100
文件頁數(shù): 5/16頁
文件大?。?/td> 125K
代理商: IDT707288L20PF8
6.42
IDT707288S/L
High-Speed 64K x 16 Dual-Port Static RAM
Industrial and Commercial Temperature Ranges
13
NO
T RECOMMENDED
FOR
NEW
DESIGNS
Timing Waveform of Mailbox Read after Write Timing, Either Side(1,2)
NOTES:
1.
CE = VIH for the duration of the above timing (both write and read cycle), refer to Truth Table I.
2.
UB and LB are controlled as necessary to enable the desired byte accesses.
Timing Waveform of Left Port Write to right Port Read of Same Data(1,2,3)
NOTES:
1.
UB and LB are controlled as necessary to enable the desired byte accesses.
2. Timing for Right Port Write to Left Port Read is identical.
3. Refer to Truth Table I and IV.
BKSEL0-3
3592 drw 10
tWC
I/O0L-15L
ADDRESSES MATCH
R/
WL
DATAIN
VALID
DATAOUT
VALID
Read Cycle
Write Cycle
CEL
A0L-13L
and A0R-13R
CER
I/O0R-15R
R/WR
OER
tAS
tWP
tAW
tEW
tDW
tDH
tWR
tBS
tLZ
tACE
tHZ
tOH
,
MBSEL
3592 drw 11
tAW
tEW
tMOP
I/O0-15
VALID ADDRESS
tMAA
R/
W
tWR
tOH
tACE
VALID ADDRESS
DATAIN
VALID
DATAOUT
VALID
tDW
tWP
tDH
tAS
tMWRD
tAOE
Read Cycle
Write Cycle
A0-A5
OE
相關(guān)PDF資料
PDF描述
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70V05L35PF8 8K X 8 DUAL-PORT SRAM, 35 ns, PQFP64
70V05L20J 8K X 8 DUAL-PORT SRAM, 20 ns, PQCC68
70V05L35PF 8K X 8 DUAL-PORT SRAM, 35 ns, PQFP64
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參數(shù)描述
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