參數(shù)資料
型號(hào): IDT5V9885TNLGI
廠(chǎng)商: IDT, Integrated Device Technology Inc
文件頁(yè)數(shù): 9/39頁(yè)
文件大小: 0K
描述: IC CLOCK GEN PLL 500MHZ 28VFQFPN
標(biāo)準(zhǔn)包裝: 490
類(lèi)型: *
PLL: 帶旁路
輸入: LVCMOS,LVTTL
輸出: LVCMOS,LVDS,LVPECL,LVTTL
電路數(shù): 1
比率 - 輸入:輸出: 2:6
差分 - 輸入:輸出: 無(wú)/是
頻率 - 最大: 500MHz
除法器/乘法器: 是/無(wú)
電源電壓: 3 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 28-VFQFN 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝: 28-VFQFPN(6x6)
包裝: 托盤(pán)
其它名稱(chēng): 800-2580
17
INDUSTRIALTEMPERATURERANGE
IDT5V9885T
3.3V EEPROMPROGRAMMABLECLOCKGENERATOR
MFC = 0
MANUAL FREQUENCY CONTROL (MFC) BLOCK DIAGRAM
NOTES:
This illustration shows how the configurations are arranged for each PLL. There is an ODIV bit associated with each of the four configurations.
- GIN0 and GIN1 control four configurations from PLL0.
- GIN2 and GIN3 control four configurations from PLL1.
- GIN4 and GIN4 control four configurations from PLL2.
- ODIV from each configuration determines the selection of two Output Divider Px Configurations.
CONFIG0
CONFIG1
Output Divider P2
ODIV
CONFIG0
CONFIG1
CONFIG2
CONFIG3
PLL0
Prescaler "D"
CONFIG0
CONFIG1
CONFIG2
CONFIG3
ODIV
VCO
Multiplier "M"
CONFIG0
CONFIG1
Output Divider P3
ODIV
CONFIG0
CONFIG1
CONFIG2
CONFIG3
PLL1
Prescaler "D"
CONFIG0
CONFIG1
CONFIG2
CONFIG3
PLL2
Prescaler "D"
CONFIG0
CONFIG1
CONFIG2
CONFIG3
ODIV
VCO
Multiplier "M"
OUTPUT MUX
CONFIG0
CONFIG1
CONFIG2
CONFIG3
ODIV
VCO
Multiplier "M"
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PDF描述
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