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參數(shù)資料
| 型號： | EVAL-AD5383EB |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | 32-Channel, 3 V/5 V, Single-Supply, 12-Bit, Voltage Output DAC |
| 中文描述： | 32通道，3伏/ 5 V，單電源，12位，電壓輸出DAC |
| 文件頁數(shù)： | 11/40頁 |
| 文件大?。?/td> | 1201K |
| 代理商： | EVAL-AD5383EB |
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AD5383
PARALLEL INTERFACE TIMING
Table 8. DV
DD
= 2.7 V to 5.5 V; AV
DD
= 4.5 V to 5.5 V or 2.7 V to 3.6 V; AGND = DGND = 0 V; all specifications
T
MIN
to T
MAX
, unless otherwise noted
Parameter
1
,
2
,
3
Limit at T
MIN
, T
MAX
Unit
t
0
4.5
ns min
t
1
4.5
ns min
t
2
20
ns min
t
3
20
ns min
t
4
0
ns min
t
5
0
ns min
t
6
4.5
ns min
t
7
4.5
ns min
t
8
20
ns min
t
94
700
ns min
t
104
30
ns max
t
114, 5
670
ns max
t
12
30
ns min
t
13
20
ns min
t
14
100
ns max
t
15
20
ns min
t
16
0
ns min
t
17
100
ns min
t
18
8
μs max
t
19
20
ns min
t
20
35
μs max
Rev. 0 | Page 11 of 40
Description
REG0, REG1, address to WR rising edge setup time
REG0, REG1, address to WR rising edge hold time
CS pulse width low
WR pulse width low
CS to WR falling edge setup time
WR to CS rising edge hold time
Data to WR rising edge setup time
Data to WR rising edge hold time
WR pulse width high
Minimum WR cycle time (single-channel write)
WR rising edge to BUSY falling edge
BUSY pulse width low (single-channel update)
WR rising edge to LDAC falling edge
LDAC pulse width low
BUSY rising edge to DAC output response time
LDAC rising edge to WR rising edge
BUSY rising edge to LDAC falling edge
LDAC falling edge to DAC output response time
DAC output settling time
CLR pulse width low
CLR pulse activation time
1
Guaranteed by design and characterization, not production tested.
2
All input signals are specified with t
R
= t
R
= 5 ns (10% to 90% of DV
DD
) and timed from a voltage level of 1.2 V.
3
See Figure 7.
4
See Figure 29.
5
Measured with the load circuit of Figure 2.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EVAL-AD5398EB | 120 mA, Current Sinking, 10-Bit, I2C DAC |
| EVAL-AD5415EB | Dual 12-Bit, High Bandwidth, Multiplying DAC with 4-Quadrant Resistors and Serial Interface |
| EVAL-AD5426EB | 8-/10-/12-Bit High Bandwidth Multiplying DACs with Serial Interface |
| EVAL-AD5432EB | CAP, .22UF, 10V, SMT, 0603 |
| EVAL-AD5443EB | CAP X7R 470PF 50V 10% 0603 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EVAL-AD5390EB | 制造商:Analog Devices 功能描述: |
| EVAL-AD5390EBZ | 功能描述:BOARD EVALUATION FOR AD5390 RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評估板 - 數(shù)模轉(zhuǎn)換器 (DAC) 系列:- 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標準包裝:1 系列:- DAC 的數(shù)量:4 位數(shù):12 采樣率（每秒）:- 數(shù)據(jù)接口:串行，SPI? 設(shè)置時間:3µs DAC 型:電流/電壓 工作溫度:-40°C ~ 85°C 已供物品:板 已用 IC / 零件:MAX5581 |
| EVAL-AD5391EB | 制造商:Analog Devices 功能描述:EVALUATION BOARD I.C. - Bulk 制造商:Rochester Electronics LLC 功能描述: |
| EVAL-AD5391EBZ | 功能描述:BOARD EVALUATION FOR AD5391 RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評估板 - 數(shù)模轉(zhuǎn)換器 (DAC) 系列:- 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標準包裝:1 系列:- DAC 的數(shù)量:4 位數(shù):12 采樣率（每秒）:- 數(shù)據(jù)接口:串行，SPI? 設(shè)置時間:3µs DAC 型:電流/電壓 工作溫度:-40°C ~ 85°C 已供物品:板 已用 IC / 零件:MAX5581 |
| EVAL-AD5392EB | 制造商:Analog Devices 功能描述:EVAL BD FOR 8-/16CH, 3V/5 V, SERL INPUT, SGL-SUPPLY,12-/14BI - Bulk |
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